Gast
#4876094
Hallo, ich bin da auf ein Problem mit dem ModelSim Simulator gestoßen und zwar sieht er in einem Signal (std_logic_vector) anstelle von den '1'sen immer ein 'X'. Das hat zur Folge das in dem Prozess der mit diesem Signal arbeitet ein case nicht mehr funktioniert da er da anstelle von z.B. "00010000" ein "000X0000" sieht. Ich habe meine Dateien mal angehängt, es geht um das Signal "instruction" in "gcpu_soc.vhd". Das ROM aus dem die Daten kommen wird mit dem Inhalt von "ROM.BIT" (evtl. in der Version noch "ROM.HEX") initialisiert. Das Funktioniert auch in der Simulation, ich sehe das im ROM die std_logic_vector richtig sind '1'sen und '0'en aber "instruction" bekommt nur 'X'e und '0'en. Woran könnte das wohl liegen?