Gast
#387723
Hallo, ich stehe gerade vor einem Problem: Ich habe noch nicht so große Erfahrung mit FPGA, will jetzt aber mal ein neues Projekt beginnen, wofür ich aber fertige IP-Cores mit verwenden möchte. Hier wird jedoch immer die Größe in LUT´s angegeben, mit denen ich nicht viel anfangen kann. Bei Xilinx werden immer nur die Anzahl Logikzellen angegeben... Ist das im Prinzip oder besteht eine Loikzelle aus mehreren LUT´s? Ich habe einen Spartan3 1000k in dem ich eine FPU mit verwenden möchte, die mit 8000 LUT´s in einem Virtex 2 angegeben ist und in einem Asic mit 20k Gattern realisiert werden könnte. Von den Gattern würde es ja reichen, aber wie siehts mit den LUT´s aus? Gruß Markus