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Forum: FPGA, VHDL & Co. Error: "No default binding for component"


Autor: Sebastian H. (Gast)
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Hi,

ich hab hier eine ISE Fehlermeldung auf die ich keinen Rat weiß.

ERROR:Xst:762 -
"C:/Programme/Xilinx/MyProjects/CCD_READER/pwm_comparator.vhd" line
97: No default binding for component: <reg>. Port <D> does not match.

Ich hab mal die relevanten Teile zusammen kopiert und angehängt. Ich
denke mal das es wahrscheinlich an der generic-Anweisung liegt, weiß
nur nicht wie ich das geschickt umgehen kann. Sicher seht ihr den
Fehler gleich.

Gruß,
Sebastian

Autor: Klaus Falser (Gast)
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Die Signale data_input oder addr_input müssen eine falsche Länge haben.
Welches davon steht an Zeile 97 ?

Klaus

Autor: Sebastian H. (Gast)
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die zeilen 97 - 102 lauten:
cmp_reg : reg generic map (BITS => D_WITDH)
port map (CLK    => clk,
  RESET  => reset,
  ENABLE => load_cmp_reg,
  D      => data_input,
  Q      => data_reg1);

deshalb dachte ich eigentlich das es an dem generic liegt.
Werde jetzt mal die ganzen Längen der Signale checken.

Gruß,
Sebastian

Autor: Sebastian (Gast)
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Hab den Fehler gefunden.
In component reg war port D ein Ausgang. Muß aber ein Eingang sein.

Gruß,
Sebastian

Autor: Jürgen Schuhmacher (Gast)
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Da ist aber der Compiler vorher schon drüber gestolpert und hat erst gar
nichts erzeugt, das dann später hätte gebunden werden können.

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