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Forum: Mikrocontroller und Digitale Elektronik Write cycle SRAM


Autor: Tobias (Gast)
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Guten Abend!

Im Anhang befindet sich das Timing für den Schreibzyklus bei einem SRAM. 
Irgendwie sind solche Diagramme bömische Dörfer für mich und ich bin mir 
nicht sicher, ob ich es richtig interpretiere.

Startbedingung: /CE und /WE high

1. gültige Adresse anlegen
2. tSA warten
3. /CE zusammen mit /WE low
4. tHZWE warten
5. zu schreibende Daten anlegen und tSD halten
6. /CE zusammen mit /WE high
7. Daten noch tHD halten

Bei Punkt 4 bin ich mir nicht sicher. Wann muß ich die Daten anlegen, 
nachdem /CE und /WE auf low gingen? Eigentlich ist es ja nicht die Zeit 
tHZWE, nur finde ich die richtige Zeit nicht im Diagramm.

Wäre nett, wenn mal jemand schauen könnte.

MfG
Tobias

Autor: Peter Dannegger (peda)
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In der Regel legt man Adresse, Daten, /CS zusammen an.

Der Schreibzyklus beginnt dann mit /WE = 0, dann die minimale 
Schreibzeit abwarten und /WE = 1.

Lesen ist genau so, bloß dann /OE statt /WE pulsen.


Peter

Autor: Tobias (Gast)
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Und die minimale Schreibzeit wäre dann tPWE1 bzw. tPWE2, oder dann doch 
eher tWC? Ich vermute mal letzteres, weil tPWE1/2 wesentlich kürzer ist, 
als tWC.

Autor: Michael U. (Gast)
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Hallo,

sieht nach dem Timing eines Cache-Rams aus, die haben aus 
Geschwindigkeitesgründen oft solche Sondermodi wie WE-controlled. Heißt 
nur, daß _CE auch durchgehend aktiv bleiben kann, wenn mehrere Bytes 
geschrieben werden sollen und nur mit _WE gesteuert wird.
Wenn das Ding z.B. an einen AVR ran soll, dann funktioniert auch bei 
diesen Rams eigentlich immer die von Peter angegebene Variante.
Müßte im Datenblatt unter CE-controlled o.ä. zu finden sein.

Gruß aus Berlin
Michael

Autor: Tobias (Gast)
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Es handelt sich um den IS61C256AH-12, Datenblatt im Anhang. Es gibt da 
drei Modi und irgendwie sind die alle /WE gesteuert :(

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