Ich habe schon von einigen Leuten gehört dass man im ISE aus normalem textbasiertem VHDL Code ein Schematic-File generieren kann. Kann mir irgendjemand erklären wie das geht?
Ist es zweckemäßig das zu tun? - bzw notwendig, um in der ISE eigene HDLS zu handeln ? Ich kenne das nur vom HDL-Designer, der VHDLs "hosten" kann, ohne sie zu modifizieren!
Danke für den Tipp mit dem XST. Ich weiß aber leider nicht was das ist. Könnte mir jemand eine Anleitung für das schicken, oder könnte es mir jemand erklären?
Am einfachsten ISE-Project-Navigator starten, neues Projekt erstellen, VHDL-files einbinden und auf Synthese klicken. XST ist das interne Synthesewerkzeug von ISE.
Damit schlage ich mich gerade herum. Ich habe es geschafft, einige Designs, die zuvor vollkommen textbasiert organisert waren, einzubinden. Dabei stellt sich die Frage, wie man da im Detail vorgeht. Es ist mir z.B: passiert, daß ich nach der Synthese von einem file nur noch einen warpper hatte, der von der ISE erzeugt worden sein muss, der mein eigentliches file weggetötet hat. Wie verhindert man das? Wie gehe ich mit Cores um? Müssen die als Symbol rein? Was ist mit einer HDL, die einer andere als Komponente einbindet ? Wenn ich die Komponente als Symbol generiere, kann ich sie noch nicht irgenwi verwenden. Ich müsste auch das übergeordnete HDL in ein SCH verwandeln, um die untergeordnete Komponente grafisch einsetzen zu können. Tue ich das aber, so geht der Zusammenhang verloren, da ich ja dann meine originale HDl überschreibe, wenn das neue SCH synthetisiert wird. Ist das so richtig ? Wenn ich das so sehe, kann ich eigentlich nur dann alles in SCH und SYM verwandeln, wenn die Hierarchie überall gleich tief ist, es also keine Mischformen von HDL und HDL+Komponenten gibt. Oder anders gesagt: Die SCH enthalten nur weitere SCH oder Symbole, aber keinen CODE. Vorschlag für eine sinnvolle und effiziente Vorgehensweise?
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