Gast
#570654
Hallo. ICh habe mir ein Actel 8051 EvalBoard zugelegt um ein bisschen mit dem Core8051 rumzuspielen. Jetzt bin ich gerade dabei ein Design aufzusetzen, und da stellen sich mir ein paar Fragen. Auf dem Board hab ich einen SRAM (128Kx36) und ein 32MB Flashmemory zur Verfügung. Der 8051 hat ja die verschiedenen Speicher CODE, XDATA, DATA usw. Der CODE und XDATA unterstützen jeweils bis zu 64kBytes und liegen Adressparallel. Der DATA wird intern im FPGA realisiert. CODE und XDATA haben jeweils ein eigenes Schreibe & Lesesignal. Aber mit dem Keil Debugger kann ich das Programm nicht in den Flash laden. Über einen Adressdecoder würde ich jetzt die einzelenen Speicher einteilen, was mir ja ein zusätzliches Enable-Signal bringt. Jetzt hab ich in den UserGuides gelesen das CODE und XDATA in den selben Speicher gelegt werden können. Wie soll das funktionieren, denn beide sind ja Adressparallel und würde sich gegenseitig überschreiben? Mit den Enable & SChreibsignalen kann ich ja nur den Baustein oder die Bank aktivieren, aber ohne gebankten Speicher ist das ganze für mich ein Rätsel. Vielleicht habt ihr ne Idee. Danke, gruß