Forum: FPGA, VHDL & Co. generic STD_LOGIC_VECTOR auf 0 setzen


generic STD_LOGIC_VECTOR auf 0 setzen
von Peter (Gast)

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Hallo,

Ich steh gerade irgendwie auf der Leitung...
Ich habe einen STD_LOGIC_VECTOR mit variabler Länge, den ich auf 
00000..0 setzen will.

[...]

generic (
  bitbreite: integer range 2 to 32;
);

[...]

signal data_reg : STD_LOGIC_VECTOR ((bitbreite-1)  DOWNTO 0);

[...]

?? data_reg alle Bits auf '0' stzen ??


Sollte eigntlich kein Problem sein, aber ich schaffe es gerade nicht..

Ich bitte um Erleuchtung
Vielen Dank!

Peter

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Re: generic STD_LOGIC_VECTOR auf 0 setzen
von Falk B. (falk)

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@ Peter (Gast)

>Ich habe einen STD_LOGIC_VECTOR mit variabler Länge, den ich auf
>00000..0 setzen will.

1
generic (

2
  bitbreite: integer range 2 to 32;

3
);

4
5
data_reg <= (others =>'0');

MFG
Falk

  


  




  

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    Re: generic STD_LOGIC_VECTOR auf 0 setzen
  


  

    

      von
      
        Peter (Gast)
      
      


      
    


    

      
    

    

    

  
  


  

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Danke!
Es ist so einfach wenn man weiß wie es geht ...

  


  




  

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