Frage zum Datenblatt AT24C16A

Thomas OP #749962
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Hallo, ich probiere gerade ein serielles EEPROM anzusteuern und habe da 
eine Frage zum Datenblatt da das Diagramm etwas fragwürdig ist, weils 
dort so ausschaut das nach dem Senden die Datenleitung durch das EEPROM 
runtergezogen wird. In der Erklärung steht "This happens during the 
ninth clock cycle."

Wird nach dem Senden des 8ten Bits automatisch die Datenleitung auf Low 
gezogen oder erst nach dem takten?
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Falk B. #749964
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@  Thomas O. (kosmos)

>dort so ausschaut das nach dem Senden die Datenleitung durch das EEPROM
>runtergezogen wird. In der Erklärung steht "This happens during the

Das ist auch so.

>ninth clock cycle."

Nennt sich, wie du schon erkannt hast ACK, Acknowledge, Bestätigung.

>Wird nach dem Senden des 8ten Bits automatisch die Datenleitung auf Low
>gezogen oder erst nach dem takten?

Nach der fallenden Flanke von SCL.

MfG
Falk
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