Gast
#843022
Ich möchte meine VHDL-Testbench besser strukturieren und z.B. organisierte Abläufe von der eigentlichen Testumgebung trennen, weil sowohl Ablauf, als auch Testumgebung varieren. Z.B. habe ich mehrere Hardwarekonstellationen (altes Prozessorboard, neues Prozessorbard mit jeweils alten AD-Wandlern und neuen Wandlern), die mit unterschiedlichen Testbenches zusammengesetzt sind, welche aber auf dieselbe Weise geprüft werden müssen. Da ich die verschiedenen Testbaläufe nur einmal schreiben und dann zu den Testbenches hinzuladen will, sollen die als Funktionsaufrufe abgespalten werden und in eine eigene Datei. Die Funktionen sollen aber trotzdem die Signale an die einzelnen Module in der Testumgebung anlegen können. Problem: Wie komme ich über die entity-Grenze hinweg?