Gast
#865306
Guten Abend Ich arbeitet zur Zeit an einem kleinen VHDL-Projekt, leider bin ich im Zusammenhang mit Funktionen auf ein Problem gestossen. Die grobe Struktur meines Codes:
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In der mit einem * markierten Zeile tritt der erste Compiler-Error auf. Error: CSVHDL0002: MICRO2.VHD: (line 379): syntax error, unexpected IDENTIFIER, expecting TYPE_NAME or LIBRARY_NAME or PACKAGE_NAME Ist es tatsächlich nicht erlaubt std_logic als Rückgabetyp für eine Funktion zu verwenden? Oder was mache ich falsch? Vielen Dank für Eure Hilfe. Gruss Karsten