Forum: FPGA, VHDL & Co. VHDL Type conversion Time -> Real


VHDL Type conversion Time -> Real
von Flo (Gast)

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Hey,

ich will ein Datum vom Typ time in real konvertieren. Folgende Anweisung 
hab ich dafür testweise geschrieben:

1
constant ClkPeriod : time := 10 ns;

2
...

3
4
process(...)

5
variable check : real;

6
begin

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8
check := real(ClkPeriod/10 us);

9
end process;


Mein Problem ist, dass check immer den Wert 0 hat. Irgendwie 
funktioniert das nicht, aber ich seh den Fehler nicht.

check soll einfach den reinen Zahlenwert der ClkPeriod halten, und zwar 
konvertiert in Microsekunden.

  


  




  

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    Re: VHDL Type conversion Time -> Real
  


  

    

      von
      
        Lothar M.
            (Firma: Titel)
        (lkmiller)
        (Moderator)
      
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Ist ja klar, was (10 ns / 10 us) in Integer gibt: 0

Du solltest das etwas weiter greifen und erst mal die Zeit in eine Zahl 
umwandeln, und danach erst teilen, nicht ohne zuvor das Ganze nach real 
gecastet zu haben:
1
   signal timeinus : real := 0.0;

2
   :

3
   timeinus <= real(ClkPeriod/1 ps) / real(1 us/1 ps);


BTW:
> und zwar konvertiert in Microsekunden.
Dann ist es ungeschickt, durch 10 us zu teilen...  :-o

  


  




  

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