Lattice ispLever / Aldec Active-HDL Blockschlatbild erstellen?

hi,

mit dem ispLEVER kann man ja auf die vhdl-datei gehen und rechts im 
process-fenster "generate schematic symbol" auswählen. dann wird ein 
blockschaltbild zu deiner schematic-symbol-lib hinzugefügt welches du 
dann verwenden kannst.

im aldec simulator gibt es ein tool "code2graphics" allerdings habe ich 
dafür keine lizenz. das würde mich aber auch interessieren ob der damit 
einen schaltplan auf gatterebene machen kann.

mfg

Andi

hi,

mit der funktion "generate schematic symbol" erstellt er mir ja die 
jeweiligen symbole aber keine verknüpfungen unter den einzelnen modulen.
die muss ich ja dann von hand setzen/ziehen.
Oder gibt es noch eine andere methode damit er mir auch die 
verknüpfungen generiert die ich in vhdl-code umgesetzt hab?

p.s. "code2graphics" habe ich leider auch nicht die erforderliche lizenz

hi,

naja wenn du die top_level_entity als symbol hast dann ist ja dein 
ganzes system in dem blockschaltbild. zusammen mit deinen 
modulverknüpfungen die du in vhdl geschrieben hast.
wenn du allerdings jedes modul einzeln generierst dann musst du die 
verbindungen selbst setzen denk ich.

hab mal wegen diesem code2graphics tool gegoogelt und festgestellt das 
dieses ja nur einen PAP zum vhdl code macht. weiss jemand wie ich mit 
dem ispLever einen schaltplan auf gatterebene generieren kann??
also so wie hier: Beitrag "Mux in Xilinx Webpack 11.3 "RTL schematic viewer""
ein rtl-shematic.


mfg

Andi

hallo nochmal :-),

also ich hab jetzt mal direkt in dem synplify tool nachgeschaut und 
entdeckt dass es doch geht. (siehe bild)

bei hdl-analyst -> rtl -> flattened view

ich hab die pro version nicht. aber mit der normalen gehts wohl auch.

mfg

Andi