Gast
#1675204
Hallo, vielleicht kann mir jemand weiterhelfen, wie kann man mit geringem Aufwand ein digitales 15 KHz Filter in VHDL realisieren ? Ich weis das es ich bei einem digitalen Filter um ein Schieberegister handelt in diesem jedes Bit mit durch eine gewichtete Multiplikation mit anschließender Addition modifiziert wird. So, die erste Frage ist, welchen Filter wähle ich FIR oder IIR ? Wie kann ich die Koeffizienten ermitteln? Meine zu demodulierenden Daten bekomme ich aus einem ADC. Was mir auch noch nicht ganz klar ist, ist wo die Frequenzinformation drin steckt? Vielleicht kennt sich jemand gut mit der Filtermodellierung in VHDL aus und kann mir helfen. Vielen Dank im Voraus.