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Forum: FPGA, VHDL & Co. Handshake zwischen VHDL prozessen


Autor: Knoepfle (Gast)
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Hallo,

hat evtl. mal jemand einen Codeschnipsel für die synchronisation
zwischen zwei VHDL - Prozessen ?

Ich möchte - sagen wir -
ein Byte über eine interne Schnittstelle auslesen.

Wenn ich flankenorientiert arbeite und Prozess A signalsiert Prozess B 
das ein Datum abzuholen ist mit einer Flanke, dann könnte Prozess B 
durch eine Flanke dem Prozess A signalsieren, dass das Datum abgeholt 
wurde.
Kostet zwei Signale.

Macht man das so ?

Ich hätte es gerne lieber Level-Orientiert, weil ich da sicherer bin das 
diese Mimik nicht durcheinander kommt. Aber das ist auch nicht so 
einfach.

A signalisiert B durch "H" - Level das vorhandensein eines Datums.
Prozess B arbeitet Datum ab und signalisiert durch "H" - Level
das die Bearbeitung beendet ist. Und dann ?

Zuerst A auf "L" - Level - wenn dann B ein "L" sieht -- B auch auf "L" ? 
Wenn A sieht das B auch auf low ist gehts wieder von vorne los.
Kostet auch zwei Signale.

Wie macht Ihr das ?
Was ist am einfachsten und Narrensicher ?

Gruß

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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Knoepfle schrieb:
> A signalisiert B durch "H" - Level das vorhandensein eines Datums.
> Prozess B arbeitet Datum ab und signalisiert durch "H" - Level
> das die Bearbeitung beendet ist. Und dann ?
Nimmt A seinen H-Pegel weg.
B erkennt das und nimmt seinen H Pegel weg.
Ruhezustand: beide sind L.

Das geht am einfachsten in einer State-Machine...

Autor: FPGASchubser (Gast)
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Danke,

ich wollte nur hören, dass es die Profis es auch so machen.

Gruß

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