Gast
#2438802
Hatte gerade in der Uni ein Arbeitsblatt zum Chipdesign. Der Assistent war nicht sooo fit und ich habe noch ein paar Fragen. Es ging darum den Leistungsverbrauch des Chips zu ermitteln, einmal mit verrauschtem und einem mit nicht verrauschtem Eingangssignal. Was ich rausfinden konnte, war das durch Rauschen in diesem Design mehr Leistung verbraucht wurde (Es war ein Regler implementiert welcher dann mehr korrigieren und somit mehr schalten musste). Die Frage war dann noch ob das Zeitverhalten und die benoetigte Chipflaeche veraendert wird. In diesem Design war das meiner Meinung nach nicht der Fall. Aber gibt es nicht Faelle in denen das so ist? timing wird durch Rauschfehlerkorrektur beeinflusst??? Durch mehr spendierte Flaeche wird der Chip rauschunanfaelliger??? eigentlich Quatsch, was meint ihr?