Forum: FPGA, VHDL & Co. "LOCKED_OUT" von DCM richtig verarbeiten?


von Dosmo (Gast)


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Hallo,

ich hab einen externen Takt, der in den FPGA hineingeht. Ich führe den 
Takt in einen DCM und erzeuge daraus zwei Takte (1:1 und 1:2) für meine 
Logik.
Der DCM hat einen Ausgang "LOCKED_OUT", der mir (wenn ich's richtig 
verstehe) anzeigt, daß der DCM sich zum externen Takt synchronisiert hat 
und die erzeugten Takte "gültig" sind, richtig?

Wie gehe ich mit diesem Signal um?
1
process (Locked, Clock) 
2
begin
3
  if( Locked= '1') then
4
    if (rising_edge(Clock)) then

oder
1
process (Clock) 
2
begin
3
  if (rising_edge(Clock)) then
4
    if( Locked= '1') then

oder anders?

von Christian R. (supachris)


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Du kannst das auch ignorieren und beim BitGen angeben, dass das FPGA 
beim Konfigurieren auf das Locked des DCM warten soll. Dann rennt die 
Logik erst los, wenn Locked = 1 ist und du hast definierte 
Anfangszustände.
Kannst aber auch das invertierte Locked Signal als synchronen Reset für 
ausgewählte Teile des Designs benutzen.

von Dosmo (Gast)


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Christian R. schrieb:
>Du kannst das auch ignorieren und beim BitGen angeben, dass das FPGA
>beim Konfigurieren auf das Locked des DCM warten soll. Dann rennt die
>Logik erst los, wenn Locked = 1 ist und du hast definierte
>Anfangszustände.

Das wär natürlich cool.

> Kannst aber auch das invertierte Locked Signal als synchronen Reset für
> ausgewählte Teile des Designs benutzen.

Das ist genau meine Frage: Darf ich LOCKED wirklich als synchrones 
Signal ansehen, wenn der Clock, zu dem es synchron sein soll, ggf. noch 
gar nicht stabil ist?

von Christian R. (supachris)


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Dosmo schrieb:
> Das ist genau meine Frage: Darf ich LOCKED wirklich als synchrones
> Signal ansehen, wenn der Clock, zu dem es synchron sein soll, ggf. noch
> gar nicht stabil ist?

Meiner meinung nach ja, denn das Entscheidende am Reset ist das 
Verlassen des reset-Zustandes. Und das ist beim Locked synchhron mit dem 
Takt.

Wobei mir die Sache mit BitGen selbst besser gefällt, setzt aber voraus, 
dass der Takt nicht erst zugeschaltet wird oder ähnliches.

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