Forum: FPGA, VHDL & Co. ISE 14.3 - Diskrepanz zwischen Summary und Timing Report


von pks (Gast)


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Hallo,

Wenn ich nach dem PAR im Timing Report Setup-Fehler finde, sollte doch 
im Summary nicht "All Constraints Met" stehen, oder?

Gruß

von Christian R. (supachris)


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PAR dreht ja mehrere Runden, üblicherweise sind in den ersten davon noch 
Setup- und/oder Hold Fehler drin.

von pks (Gast)


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Aber das erklärt doch nicht, warum im Design Summary steht, dass alle 
Constraints eingehalten wurden, während im finalen Timing-Report immer 
noch Fehler sind.

von Christian R. (supachris)


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Dann ist das in der Tat seltsam. Kannst du den Report mal posten?

von pks (Gast)


Angehängte Dateien:

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Ab Zeile 4222.

von Duke Scarring (Gast)


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Passt der Speedgrade (-2) auch zu den anderen Einstellungen?
Der Microblaze wird mit 125 MHz getaktet?

dsp_module_I4 liegt auf DSP48_X1Y26 und
dsp_module_I5 liegt auf DSP48_X1Y25
Das sieht für mich so aus, als wenn die nicht näher zusammenrücken 
können.

Brauchst Du die FPU im Microblaze? Die Marketingzahlen vom Microblaze 
(irgendow hab ich mal was von 300 MHz gelesen) sind geschönt und 
handoptimiert :-(
Ich fürchte mit der FPU im Microblaze wirst Du nur ~ 115 MHz schaffen.

Duke

von pks (Gast)


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Duke Scarring schrieb:
> Passt der Speedgrade (-2) auch zu den anderen Einstellungen?

Wie meinst Du das?

Ja, der MB läuft mit 125 Mhz. Die FPU war eigentlich schon eingeplant. 
Ich werd mal checken ob ich ohne auskomme...

von Duke Scarring (Gast)


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pks schrieb:
>> Passt der Speedgrade (-2) auch zu den anderen Einstellungen?
> Wie meinst Du das?
Ich hab mich auch schon mal über die Diskrepanz zwischen par und 
trce gewundert.

Es stellte sich dann heraus, das die Beiden von verschiedenen 
Speedgrades ausgingen. Ich hatte dazu aber nicht den in ISE integrierten 
Workflow verwendet, sondern etwas eigenes.

Duke

von Frank H. (Gast)


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Könnte man dies auch auf andere Tool Teile übertragen? Will heissen, 
kann es sein, dass die Tool chain teilweise inconsistent ist? Ich habe 
nämlich den Effekt, dass ich bei ein und demselben design, die timings 
mal deutlich treffe und andermal deutlich verfehle, ohne dass es dafür 
einen grund gibt.

von Lothar M. (Firma: Titel) (lkmiller) (Moderator) Benutzerseite


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Frank H. schrieb:
> kann es sein, dass die Tool chain teilweise inconsistent ist?
Nein, denn Duke Scarring schrieb:
>> Ich hatte dazu aber nicht den in ISE integrierten Workflow verwendet
Sondern ein eigenes Makefile/Script, bei dem offenbar irgendwelche 
Schalter falsch gesetzt wurden...

von pks (Gast)


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Frank H. schrieb:
> Ich habe
>
> nämlich den Effekt, dass ich bei ein und demselben design, die timings
>
> mal deutlich treffe und andermal deutlich verfehle, ohne dass es dafür
>
> einen grund gibt.

Du meinst wirklich das selbe Design? Dass es bei einer noch so winzigen 
Änderung zu einem ganz anderen Timing kommt ist leider völlig normal.

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