avr-gcc IOReg

Vogel Gast #4287283
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void spi_master_init(void)

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{

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  // Setze /SS, MOSI und SCK als Ausgang

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  DDRB |= (1<<PORTA7) | (1<<PORTA6) | (1<<PORTA4);

5
  // Aktiviere SPI als Master, SCK = CK/4

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  SPCR = (1<<SPE) | (1<<MSTR);

7
  IOReg = SPSR;

8
  IOReg = SPDR;

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}


Habe das in den AppNotes von Atmel gefunden. IOReg ist beim Compilieren 
nicht bekannt. Was bewirkt es, und wie kann ich es fixen.
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Tom Gast #4287287
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Irgendwer hat eine Zeile nicht mitkopiert, eigentlich sieht das so aus 
(aus AVR151.zip):
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// Intialization Routine Master Mode (polling)

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void Init_Master (void)

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{

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        volatile char IOReg;

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        // set PB4(/SS), PB5(MOSI), PB7(SCK) as output 

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        DDRB    = (1<<PB4)|(1<<PB5)|(1<<PB7);

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        // enable SPI in Master Mode with SCK = CK/4

8
        SPCR    = (1<<SPE)|(1<<MSTR);

9
        IOReg   = SPSR;                   // clear SPIF bit in SPSR

10
        IOReg   = SPDR;

11
}


IOReg ist volatile, damit der Lesezugriff auf SPSR und SPDR nicht 
wegoptimiert wird, obwohl einen der Inhalt von IOReg nicht interessiert. 
Man braucht hier die Nebenwirkungen des Lesens (nämlich das Löschen 
gewisser Bits, Details siehe Datenblatt).
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Rolf M. #4287355
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Tom schrieb:
> IOReg ist volatile, damit der Lesezugriff auf SPSR und SPDR nicht
> wegoptimiert wird, obwohl einen der Inhalt von IOReg nicht interessiert.

Wenn der Zugriff auf SPSR und SPDR nicht wegotimiert werden darf, müssen 
SPSR und SPDR volatile sein, was sie vermutlich auch sind. Wie IOReg 
definiert ist, ist dann eigentlch egal. Genau genommen braucht man es 
gar nicht. Es reicht zu schreiben:
1
    SPSR;

2
    SPDR;

IORreg volatile zu machen, sorgt eigentlich nur dafür, daß der aus SPSR 
gelesene Wert nicht nur eingelesen, sondern auch nochmal extra in den 
RAM kopiert wird, bevor er verworfen wird.
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