Guten Abend,
als Teil einer Ausarbeitung, kümmere ich mich zur Zeit um eine
'Frequenzauswahl', welche nur einen Teil eines ganzen Projekts abbildet
um anschließend auf Spartan dargestellt zu werden.
Durch Auswahl von 'TONF1K' bzw. 'TONF05K' kann zwischen zwei Frequenzen
(1kHz und 0,5kHz) gewählt werden. Die ausgewählte Frequenz wird als
'Ton' ausgegeben, um es als akustisches Signal auszugeben. Die
Eingangsfrquenz 'clk' ist 50MHz.
Als Anfänger habe ich mich bestmöglichst in das Thema eingearbeitet, das
Resultat seht ihr im folgenden als Quellcode.
Als Grundlage für die Frequenzdarstellung dient Lothar Miller's 'Hello
World' (lothar-miller.de/s9y/archives/80-Hello-World!.html)
Im ISE Project Navigator hab den Synthesizer über den Quellcode laufen
lassen, der mir einiges an Fehlern ausgegeben hat, die ich soweit, bis
auf die unter dem Quellcode aufgeführten, beseitigen konnte.
Meine Gedanken zu den restlichen Fehlern, habe ich unten aufgeführt.
1 | 1 library IEEE;
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2 | 2 use IEEE.STD_LOGIC_1164.ALL;
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3 | 3 use IEEE.NUMERIC_STD.ALL;
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4 | 4
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5 | 5 entity Tonbaustein is
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6 | 6 Port ( clk, TonF1K, TonF05K : in bit;
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7 | 7 Ton : out STD_LOGIC);
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8 | 8 end Tonbaustein;
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9 | 9
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10 | 10 architecture Verhalten of Tonbaustein is
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11 | 11
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12 | 12 signal TonF1K_INT, TonF05K_INT: bit;
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13 | 13 signal c : integer range 0 to 49999 := 0;
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14 | 14 signal d : integer range 0 to 99999 := 0;
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15 | 15 signal x : std_logic:= '0';
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16 | 16 signal y : std_logic:= '0';
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17 | 17
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18 | 18 begin
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19 | 19
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20 | 20 FT1: process (clk, TonF1K_INT, c, x)
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21 | 21
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22 | 22 begin
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23 | 23
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24 | 24 wait until rising_edge(clk); -- warten bis zum nächsten Takt
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25 | 25 if (c<49999) then -- 0…49999 = 50000 Takte = 20µs Sekunde bei 50MHz
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26 | 26 c <= c+1; -- wenn kleiner: weiterzählen
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27 | 27 else -- wenn Zählerende erreicht:
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28 | 28 c <= 0; -- Zähler zurücksetzen
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29 | 29 x <= not x; -- und Signal x togglen
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30 | 30 end if;
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31 | 31 end process FT1;
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32 | 32 TONF1K_INT <= x; -- Signal x an Frequenzteiler ausgeben
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33 | 33
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34 | 34
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35 | 35 FT2: process (clk, TonF05K_INT, d, y)
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36 | 36
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37 | 37 begin
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38 | 38
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39 | 39 wait until rising_edge(clk); -- warten bis zum nächsten Takt
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40 | 40 if (d<99999) then -- 0…99999 = 100000 Takte = 10µs Sekunde bei 50MHz
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41 | 41 d <= d+1; -- wenn kleiner: weiterzählen
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42 | 42 else -- wenn Zählerende erreicht:
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43 | 43 d <= 0; -- Zähler zurücksetzen
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44 | 44 y <= not y; -- und Signal y togglen
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45 | 45 end if;
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46 | 46 end process FT2;
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47 | 47 TONF05K_INT <= y; -- Signal y an Frequenzteiler ausgeben
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48 | 48
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49 | 49
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50 | 50 UND: process (TONF1K_INT, TONF05K_INT, TONF1K, TONF05K,Ton)
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51 | 51
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52 | 52 begin
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53 | 53
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54 | 54
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55 | 55 if TONF1K='1' and TonF05K='0' then Ton <= TonF1K_INT;
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56 | 56 else if TONF1K='0' and TonF05K='1' then Ton <= TonF05K_INT;
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57 | 57 else if TONF1K='0' and TonF05K='0' then Ton <= '0';
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58 | 58 else if TONF1K='1' and TonF05K='1' then Ton <= '0';
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59 | 59 end if;
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60 | 60
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61 | 61
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62 | 62 end process UND;
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63 | 63
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64 | 64
|
65 | 65 end Verhalten;
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1 | Compiling vhdl file "F:/Xilinx/TAKT/TAKTBeispiel.vhd" in Library work.
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2 | Entity <tonbaustein> compiled.
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3 | ERROR:HDLParsers:808 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 24. rising_edge can not have such operands in this context.
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4 | ERROR:HDLParsers:1405 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 24. statement WAIT not allowed in a process with a sensitivity list
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5 | ERROR:HDLParsers:800 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 32. Type of TONF1K_INT is incompatible with type of x.
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6 | ERROR:HDLParsers:808 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 39. rising_edge can not have such operands in this context.
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7 | ERROR:HDLParsers:1405 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 39. statement WAIT not allowed in a process with a sensitivity list
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8 | ERROR:HDLParsers:800 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 47. Type of TONF05K_INT is incompatible with type of y.
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9 | ERROR:HDLParsers:800 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 55. Type of Ton is incompatible with type of TonF1K_INT.
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10 | ERROR:HDLParsers:800 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 56. Type of Ton is incompatible with type of TonF05K_INT.
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11 | ERROR:HDLParsers:164 - "F:/Xilinx/TAKT/TAKTBeispiel.vhd" Line 62. parse error, unexpected PROCESS, expecting IF
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An dieser Stelle reichen meine Kenntnisse nicht aus um die
Ungereihmtheit zu verstehen. 'rising_edge' dürfte hier in einer
abgeänderten Konstelation richtig sein, 'wait until' scheint hier das
Problem darzustellen.
Wie anfangs erwähnt ist der Qeullcode zur Frequenzgenerierung von
Lothar Miller übernommen und weitestgehend angepasst. Die Konstelation
der Zeile 32 ist soweit übernommen, macht hier jedoch keinen Sinn, was
ich nicht ganz nachvollziehen kann. Ein Einschub hinter die Zeile 31
bzw. 46 bringt kein Ergebnis.
Die Überlegung hier ist: Liegt das Signal 'TONF1K' an (und an TONF05K
nicht), so soll 1kHz an 'Ton' ausgegeben werden. Das Gegenteil gilt für
0,5kHz. Liegen beide Signale gleichzeitig am Eingang an bzw. nicht an,
so wird nichts ausgegeben. Das war soweit die Überlegung, die sich
jedoch nicht umsetzten lässt.
Könnt ihr mir bei den offenen Fehlern behilflich sein?
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