Hamming Codierer

Maria S. (Firma: KIT) #4811331
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library ieee;
use ieee.std_logic_1164.all;

entity hamming-coder is
  port (
    A: in std_logic_vector (4 downto 0);
    K: out std_logic_vector (3 downto 0)
    );
  end entity hamming-coder;

architecture behavior hamming-coder is

begin


-> erbitte um Lösungsvorschläge. :)
Angehängte Dateien:
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Professor FPGA Gast #4811345
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library ieee;

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 use ieee.std_logic_1164.all;

3
 

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entity hamming-coder is

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  port (

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    A: in std_logic_vector (4 downto 0);

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    K: out std_logic_vector (3 downto 0)

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    );

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  end entity hamming-coder;

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architecture behavior hamming-coder is

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begin

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 K <= hamming (A);

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end;


Bitteschön.
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Strubi Gast #4811515
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Auch ich hätte mal wieder eine Anfrage:

Ist es möglich, in VHDL einen Nach-Hausaufgaben-Lösungen-Fragen-Erkenner 
zu schreiben, der automatisch solche Postings beantwortet?
Die Netiquette scheint ja nicht mehr zu greifen.

Ich möchte auch zu bedenken geben, dass es absolut NICHTS bringt, sich 
diese Hilfe in den Foren zu holen. Denn später wird im Job etwas mehr 
Biss erwartet, und die LinkedIn-Einserkandidaten mit fehlendem 
Einarbeitungs-Gen verseuchen die Joblandschaft schon zur Genüge.
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Mw E. (Firma: fritzler-avr.de) #4811885
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Experte schrieb im Beitrag #4811831:
> Wer da nicht mitmacht, bleibt zurück und packt erst gar nicht das
> Studium.

Also ich habs bisher ohne Beschiss gepackt.
Vollzeitstudium heißt nunmal ne 60h Woche mindestens.
Wer das nicht rafft fliegt früher oder später.

Ein Semester hat 30LP (Leistungspunkte).
1 LP = 30h Arbeitsaufwand.
-> 900h/Semester
Vorlesungszeit für das TUB WS16/17 sind 15 Wochen
-> 60h/Woche
Im Endeffekt etwas weniger, da ist auch Klusurvorbereitung mit drinne 
und die finden ja nach den Vorlesungswochen statt.
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