Ein AXI Interface mehrere Protokolle?

Gast #5125875
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Hallo,


das Dokument Xilinx AXI Reference Guide ist leider etwas ungenau.
Kann mir jemand bestätigen, dass es sich bei AXI um ein einziges 
HW-Interface handelt; AXI-full, AXI-Lite und AXI-Stream jedoch 
verschiedene Protokolle sind, die alle über das gleiche Interface, also 
mit den gleichen Datenleitungen, gesendet werden?
AXI-full, AXI-Lite und AXI-Stream beschreiben also bloß, wie AXI4 
genutzt und Daten interpretiert werden. Richtig?
Gast #5125962
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Also rein von den Leitungen ist AXI-Full und AXi-Stream schon anders 
aufgebaut als das reine AXI-Lite wenn ich es richtig in Erinnerung habe.
Ist bei mir schon ein halbes Jahr her.

Ich weiß nicht, was du vor hast, aber ich würde, wenn du selber 
VHDL/Verilog schreibst wenn überhaupt dort maximal das AXI-Lite 
nachbauen, das lässt sich relativ leicht handhaben.

Für AXI-Stream oder AXI-Full würde ich dann eher in System-C mit 
VivadoHLS etwas entwickeln. Da wird das komplette AXI-Full Interface 
dann automatisch gebaut und kann es vom C-Code aus sehr einfach 
ansprechen.
(Firma: abaxor engineering) #5126780
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olpo schrieb:
> AXI-full, AXI-Lite und AXI-Stream jedoch
> verschiedene Protokolle sind, die alle über das gleiche Interface, also
> mit den gleichen Datenleitungen, gesendet werden?

Nein das ist definitiv nicht so.

AXI-full und AXI-Lite sind klassiche Busse, mit Adress, Daten und 
Steuerleitungen. Der Unterschied besteht darin, dass AXI-Full 
Burst-Transfers bereitstellt und AXI-Lite nicht.

Mit AXI-Stream verbindet man signalverarbeitende Einheiten 
untereinander, z.B. Filter, mit  FIFOs.

Ein Beispiel wäre

                Prozessor
                   ^
                AXI-Lite
                   v
ADC <AXI-Stream> Filter <AXI-Stream> DAC

Hier kannst du Filterkoeffizienten per AXI-Lite vom Prozessor nachladen.

Tom

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