Superstates und VHDL

h4 Gast #5140079 
Hallo Comunity,

mich beschaeftigt momentan wie man Superstates in VHDL  implementieren 
kann, gibt es dazu ein Template an das man sich halten kann oder 
vernuenftige Literatur die dieses Thema aufgreift ?
Ich finde sehr viele Seiten die Superstates beschreiben aber keine von 
denen zeigt eine Implementierung :(

Vllt hat ja einer von euch eine Idee z.B. fuer folgende Maschine, die 
eine.. ehm... Tiervertreibungsanlage zum Schutz des Gartens beschreibt:

Nach dem der AN Schalter betaetigt worden ist soll der Automat zwei 
Sachen gleichzeitig ausfuehren, einerseits soll eine LED mit dem Takt 
blinken die durch die Zustaende ANZEIGE_1(LED AN) und ANZEIGE_2(LED AUS) 
beschrieben wird um zu Signalisieren das die Anlage scharf ist. Auf der 
Anderen Seite soll der Automat auf dem Bewegengsmelder (BEW) lauschen, 
falls ein Tier zu nah dran kommt soll eine PUMPE angehen das Wasser 
durch eine Duesse spritzt und ein LICHT das das Tier vertreibt, nach 
einer bestimmten Zeit z.b. 5 sek soll die Anlage wieder in den 
Wartezustand uebergehen signalisiert durch das Signal TIME.

Fuer jeden Ansatz bin ich sehr dankbar

Gruss h4
Angehängte Dateien:
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Burkhard K. #5140223 
h4 schrieb:
> Fuer jeden Ansatz bin ich sehr dankbar

Hmm, ich lese aus Deinem UML-Diagramm:
- ein Enable-Signal (An/Aus)
- einen Timer zum Togglen des LED-Signals
- eine FSM zur Steuerung des Bewegungsmelders und der 
Vertreibungsaktionen

Einen Superstate sehe ich erstmal nicht - vielleicht weil ich selten in 
UML zu denken pflege :-)
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Lothar M. Moderator (Firma: Titel) Persönliche Seite #5140500 
h4 schrieb:
> mich beschaeftigt momentan wie man Superstates in VHDL  implementieren
> kann
Ich würde einfach mal dieses Buzzword ignorieren und 2 simple Automaten 
für die 2 Aufgaben implementieren...

> Nach dem der AN Schalter betaetigt worden ist soll der Automat zwei
> Sachen gleichzeitig ausfuehren
Wie würdest du diese beiden Aufgaben in realer Hardware mit einzelnen 
Logik-Bausteinen lösen? Wenn du das weißt, dann kannst du mit VHDL diese 
Schaltung beschreiben.

h4 schrieb:
> Nach dem der AN Schalter betaetigt worden ist
Ist "der Automat" vorher stromlos, oder ist er in einem aktionslosen 
Wartezustand?
Falls zweiteres: bedeutet "AN Schalter", dass das "AN"-Signal statisch 
anliegt?
Falls ja, dann ist es völlig simpel. Falls nein, dann muss noch ein 
Zustandsautomat zum Auswerten des Schaltimpulses und Erzeugen eines 
statischen signals vor die folgenden Module geschaltet werden.

> soll der Automat zwei Sachen gleichzeitig ausfuehren, einerseits soll
> eine LED mit dem Takt blinken
Das "Hello World!" der Hardware, die Anfängerübung schlechthin...
http://www.lothar-miller.de/s9y/archives/80-Hello-World!.html

> Auf der Anderen Seite soll der Automat auf dem Bewegengsmelder (BEW)
> lauschen, falls ein Tier zu nah dran kommt soll eine PUMPE angehen
> das Wasser durch eine Duesse spritzt und ein LICHT das das Tier vertreibt
Das ist offenbar der selbe Ausgang...

> nach einer bestimmten Zeit z.b. 5 sek soll die Anlage wieder in den
> Wartezustand uebergehen signalisiert durch das Signal TIME.
Also ein Monoflop...

Fazit: diese Aufgabe ist auch bei umständlicher Beschreibung in 20 
Zeilen VHDL-Code zu erledigen.
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