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Forum: FPGA, VHDL & Co. signal'event


Autor: Plau Sein (radih)
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HAllo allerseits,

In meiner Komponente bekomme ich als Eingang ein 4 Bit Signal 
(data2send)
JEtzt wollte ich einfach schreiben:

if data2send'event

Der Compiler meckert natürlich, dass das Signal nicht nur 1 Bit ist.
Wie kann ich das anders realisieren?
Ich möchte einfach wissen, wann data2send gesetzt wurde und erst dann 
soll meine Komponente beginnen zu senden.
Bitte nur Vorschläge, die sich zu data2send'event beziehen und nicht 
z.B. Vorschläge wie:

"Setze ein zusätzliches Signal rdy ein"

Aber wenn es nicht anders geht würde ich natürlich das einsetzen müssen.

Danke im Voraus

Autor: lange Leitung (Gast)
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Ich glaube man "soll" nur clock-Signale mit diesem 'event auslesen.
Wie wäre es mit einem synchronisierten Zwischenspeichern des Signals und 
der Änderungsabfrage (if signal_alt /= signal_neu)?

Autor: Plau Sein (radih)
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ja gut, das könnte ich mal ausprobieren

Autor: Mark (Gast)
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hallo,

mit 'event geht das nicht, wenn es synthesefähig sein soll.
Stell Dir das ganze mal in Hardware vor. Wie willst Du rauskriegen
ob der 4bit Wert gesetzt wurde, wenn derselbe Wert nochmal
geschrieben wird?
Eine Änderung der Wertes kannst Du nur über einen Komparator
rausbekommen.
Einfacher wäre von "weiter vorn" ein Schreib-Flag, aus dem Du
erkennen kannst, dass der 4bit Wert neu geschrieben wurde.
Was anderes wird nicht gehen.

Autor: Plau Sein (radih)
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wow

genau das(flag) habe ich ausprobiert, während ich auf eine Antwort hier 
gewartet habe.

Also dann danke nochmals

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