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Forum: FPGA, VHDL & Co. Pin Zuweisung


Autor: Gast_1 (Gast)
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Hallo Alle!
Kann man einem Pin einen wert vom typ std_logic_vector zuweisen?

Port
(
Buffer:out std_logic_vector(15 downto 0);
:
);
Und dann bei Floorplan IO(Webpack Xilinx) so definieren

NET "Buffer" LOC="P..";
:
Danke fuer jede Hilfe.
MFG

Autor: Jörg (Gast)
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Geht schon, Pinzuweisung wird im zugehörigen UCF-File definiert.
Aber nenn das Signal nicht "Buffer", da's ein reserviertes Wort ist!

Gruss

Jörg

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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Du kannst einem Bus mit 16 Signalen nicht einen Pin zuweisen. Sondern du 
musst jedem der 16 Signale einen eigenen Pin zuweisen.
Das Zuweisen machst du üblicherweise nicht mit dem Floorplanner, sondern 
mit dem Constrains-Editor PACE (User Constraints / Assign Package Pins).
Oder direkt im User Constraints File UCF.

In der UCF-Datei sieht das dann so aus:
:
NET "Puffer<0>"  LOC = "P12"  ;
NET "Puffer<1>"  LOC = "P13"  ;
NET "Puffer<2>"  LOC = "P17"  ;
NET "Puffer<3>"  LOC = "P18"  ;
:
NET "Puffer<15>"  LOC = "P11"  ;
:

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