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Forum: FPGA, VHDL & Co. port map und Konstante ?


Autor: Marc08 (Gast)
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Habe gerade folgenden Code kompiliert:

Hier nur ein kurzer Auszug:

I_TEIL1: DISPLAY_DRIVER_FOR_PACKAGE 
      port map(
        EXP_TIME => EXP_TIME,
        NO_PICT => (2,5),
        DISPLAY => DISPLAY,
        SHOW => SHOW,
        ERR => ERR
        );

NO_PICT ist hierbei ein Array (0 to 1) vom Datentyp Integer (Range 0 to 
10).

Wenn ich jetzt das in Xilinx ISE anschaue unter View RTL Schematic, dann 
sehe ich, das das Signal NO_PICT auf Masse gelegt wurde?!?

Warum wird hier kein Look-Up-Table erzeugt?

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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Zeig doch mal etwas ausführlicher die Definition und Deklaration von 
DISPLAY_DRIVER_FOR_PACKAGE und von NO_PICT.

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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> Array (0 to 1) vom Datentyp Integer (Range 0 to 10)
Ich habe das jetzt auch so ähnlich mal ausprobiert.
Tatsächlich, mit
  type speicher is array(0 to 1) of integer range 0 to 255;
klappts nicht. Aber mit
  type speicher is array(0 to 1) of unsigned(7 downto 0);
zeigt es auch der RTL-Viewer (ISE 9.2) korrekt an.
Die Simulation funktioniert in beiden Fällen korrekt.

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