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Forum: FPGA, VHDL & Co. 2 dimensionaler buss


Autor: Uli W. (uliw2008)
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wie kann man in vhdl am einfachsten einen 2d bus beschreiben?

ich benutze einen bus multiplexer für 2 prozessoren und 4 rams und 
wuerde gerne eine 8 fach interconnect verdrahtung aufziehen, dazu 
brauche ich einen konstrukt wie bus[2 downto 0],[31 downto 0].

Autor: Jan M. (mueschel)
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Da gibts zwei Möglichkeiten: Ein Array oder ein entsprechend breiteres 
Signal, also entweder

bus : std_logic_vector(32*8-downto 0);

oder type bus_t is array(2 downto 0) of std_logic_vector(31 downto 0);

Autor: Uli W. (uliw2008)
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wie verwende ich den dan?

Autor: Klimatöter (Gast)
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wenn du das nicht weißt .. am besten gar nicht ;)

Autor: Gast (Gast)
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So, wie du es beschrieben hast!

Autor: Uli W. (uliw2008)
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also OUTPUT1[15 downto 0) = BUS[2][15 downto 0] zB. ?  Das geht nicht.

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