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Forum: FPGA, VHDL & Co. vhdl pipeline struktur


Autor: Rainer Zufall (Gast)
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hallo zusammen -

ich habe eine frage bzgl pipelining..
ich habe eine schaltung in vhdl zu umzusetzen. dabei möchte ich mehrere 
sachen parallel ausführen.. da der vhdl code später auf einem virtex4 
laufen soll meine frage:
ist es performance technisch machbar / sinnvoll 2 multiplikationen von 
jeweils 21bit*16bit und 16bit*16bit parallel auszuführen ? oder soll ich 
die multiplikationen lieber nacheinander ablaufen lassen?

wäre über vorschläge dankbar.

grüße, rainer

Autor: Christian R. (supachris)
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Da lacht der Virtex doch drüber. Der hat doch eingebaute DSP48 Slices, 
auf denen die Multiplikationen ausgeführt werden. Da geht nicht mal 
normale Logik dafür drauf. Und je nach Typ kannst du dann einige hundert 
18x18 Multiplikationen pro Takt ausführen.

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