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Forum: FPGA, VHDL & Co. IO während Global Set-Reset fest nageln(XC3S250E )


Autor: Ajo (Gast)
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Hallo,
ich steuere ein LVDS treiber(Enable Pin) mit XC3S250E.
Alles soweit ganz ok, jedoch habe ich start probleme.
Die FPGA Pins werden nach Konfig durch den internen "Global Set-Reset" 
(GSR) in ein def. zustand gebracht. genau hier schaltet mein LVDS 
Treiber ein und aus und ein!
Kann mir vielleicht jemand sagen, wie ich das umgehen kann, so das der 
Treibernicht hin und her geschaltet wird?
Herzlichen dank im vorraus!

Autor: Antti Lukats (Gast)
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ext. pull down resistor

Autor: Ajo (Gast)
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ich probiere mal mit 10k aus.
Danke.

Autor: Antti Lukats (Gast)
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zu gross
2.2k

Autor: Ajo (Gast)
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kann ich auch dann den internen PU nehmen?

Autor: Antti Lukats (Gast)
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na hangt ja von polaritat und pullup during config setting

es ist bishen unterschiedlich per fpga famile
wie man pre configuration pullups abschalten oder einschalten kann

dein problem ist nicht GSR sonder VOR dem configuration wo FPGA
leer ist..

Antti

Autor: Ajo (Gast)
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dann ist das der POR.
Hmm, ich hab das dann wohl flasch verstanden.
Ich probiere es nun mit dem internen PD.
Herzlichen dank nochmal.
Ajo

Autor: Antti Lukats (Gast)
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internes pull up ist ja nicht aktiviert bis FPGA configuriert ist

Antti

Autor: Uwe Bonnes (Gast)
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DS312, Seite 18:

During configuration a Low logic level on the HSWAP pin
activates pull-up resistors on all I/O and Input-only pins not
actively used in the selected configuration mode.

Probier also mal HSWAP auf NULL zu legen.

Autor: Antti Lukats (Gast)
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ups ich hatte gemeient programmable PULL DOWN ist nicht aktiviert

Antti

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