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Forum: FPGA, VHDL & Co. Vergleichsproblem


Autor: Denis (Gast)
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Hallo hab mal wieder ein kleines Problem,

ich bekomme einen Datenstrom, der einen Paketzählerstand beinhaltet. 
Diesen muss ich in einer Funktion überprüfen ob der aktuelle Wert größer 
ist als der vorherig abgespeicherte Wert. Liegt daran das die 
Information auf 2 Empfängern ankommt und der einen geringern 
Phasenversatz aufweist wird bevorzugt behandelt.

Dazu ist aber ein Vergleich notwendig. Aber wie kann ich das mit 
std_logic_vector machen?

Der normale Vergleich geht ja nur mit Boolean. Doch ich habe in dem 
Stream keinen weiteren Takt den benutzen könnte, sprich eine Wandlung 
wird nicht gehen,oder?Alles muss in einem Takt abgearbeitet werden.

Gruß
Denis

Autor: Jan M. (mueschel)
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Das kommt darauf an, welche Libraries du verwendest. Mit 
std_logic_unsigned kannst du den Vergleich einfach mit den 
std_logic_vector hinschreiben. Mit numeric_std musst du erst noch in 
einen unsigned-Wert konvertieren:

> unsigned(WertA) < unsigned(WertB)

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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> Dazu ist aber ein Vergleich notwendig. Aber wie kann ich das mit
> std_logic_vector machen?
Nimm die numeric_std.all und konvertiere/caste dir den Wert zurecht:
http://www.lothar-miller.de/s9y/archives/14-Numeric_Std.html

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