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Forum: FPGA, VHDL & Co. Flanke,Enable, Anfängerfrage


Autor: Matze (Gast)
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Hallo,


fang gerade von Anfang an mit Vhld und hätte eine Grundfrage.

Wenn ich ein Enable Signal auf eine steigende Flanke von einem Clock 
beziehe, heißt es wenn das Ereignis vor der steigenden Flanke passiert 
ist,dass das Enable Signal genau bei der Steigenden Flanke von Clock auf 
1 geht? Und wenn das ereignis nach der steigenden Flanke passiert ist, 
wird es dann erst bei der nächten steigenden Flanke von Clock auf 1 
gestzt?


Bzw. sich das Enable Signal auf eine falledne Flanke bezieht und das 
Ereignis passiert nach der Fallenden Flanke , wird das Signal erst bei 
der nächsten fallenden Flanke auf 1 gesetzt? und vor der fallenden dann 
bei gleich bei diese fallenden Flanke ?

Ich hoffe ich konnte es verständlich erklären?




Gruß Matze

Autor: Iulius (Gast)
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Am besten du liest dir den Artikel auf wikipedia bezüglich des D-FF mal 
durch : http://de.wikipedia.org/wiki/Flipflop

Oder kurz : was am Dateneingang anliegt wird zur Taktflanke im FF 
übernommen. Was danach kommt erst bei der nächsten Taktflanke (außer es 
hat sich zwischenzeitlich schon wieder verändert)


Ansonsten auch empfehlenswert : Modelsim runterladen und damit 
experimentieren und die Waveforms ansehen.

Zwar gibt es in der echten Hardware weitere Effekte wie Setup/Hold 
Zeiten, aber sowas kann man als Anfänger getrost irgnorieren, zumal die 
Tools einen ohnehin von sich aus darauf hinweisen.


Achja : Falls du weder im Studium noch sonstwo bisher mit 
Logikschaltungen in Kontakt gekommen bist (kann ja sein, ist ja nichts 
Schlimmes) empfehle ich dir z.b. mal einen Foliensatz einer 
entsprechenden Vorlesung anzusehen.

Bei Bedarf suche ich gerne was passendes raus.

Autor: Matze (Gast)
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Danke, Danke!



Gruß

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