Forum: FPGA, VHDL & Co. State Machine+Prozess


von hwoarang (Gast)


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Hallo zusammen
beschäftige mich grad mit erstellung einer state machine mit fpga.
Nun ist meine Frage: könnte ich eine State machine mit nur einem
Prozess erstellen? wenn ja wie

von chris (Gast)


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ja das geht ....
http://toolbox.xilinx.com/docsan/xilinx7/books/data/docs/xst/xst0012_5.html
steht aber wohl auch in jedem buch ....

von Tom (Gast)


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@ Chris:

Superlink zur FSM in der Ein-Prozess-Darstellung...

...der große Vorteil ist die Taktung mit einer Systemclock und die
Synchronität zwischen Ein- und Ausgangssignalen...

...falls die Eingangssignale asynchron zum Systemtakt "clk"
vorliegen, die Eingangssignale über 2-3 FF noch über clk
"einsampeln", und schon steht die synchrone FSM....

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