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Forum: FPGA, VHDL & Co. Signalvektor zusammenbauen

Autor: Lösung (Gast)
Datum: 25.04.2008 10:35

Hallo,

ich muss in einem Projekt einen Signalvektor variabler Länge
"zusammenbauen".
Die Teilsignale und die jeweiligen Größen bekommen ich als std_logic
bzw. -vector.
Ich habe mir das so überlegt, den Ausgangssignalvektor so groß zu
machen, wie die kumulierte Größe aller Eingänge.
Dann wandele ich die jeweiligen Größen mit CONV_INTEGER um, damit ich
sie als Indizes für den Ausgangsvektor benutzen kann.
Ist diese Vorgehensweise soweit ok?
Autor: Jan M. (mueschel)
Datum: 25.04.2008 14:39

Für was brauchst du diesen Vektor? Die Umsetzung in Hardware lässt sich
hier sicher nicht optimieren, wahrscheinlich ist der Resourcenverbrauch
in jedem Fall nahe 0. Die Schriebweise im Code könnte man aber sicher
vereinfachen, je nach Anwendung.
Autor: Lösung (Gast)
Datum: 28.04.2008 08:55

Na dieser Vektor soll dann seriell rausgeschickt werden und besteht aus
mehreren Elementen.
Ich habs jetzt soweit aufgebaut und die Synthese meckert erstmal nicht.
;)

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