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sr04_timer.c
/* ------------------------------------------------------------------ sr04_timer.c Funktionstest fuer HC-SR04 Entfernungssensor mittels Ultraschall- echos. MCU : ATtiny44 F_CPU : 8 MHz intern Hardware : Sensor HC-SR04 Display OLED mit SSD1306 Controller Lautsprecher Fuses
in „(sehr) kleines "FrameWork" für ATtiny44“ · Projekte & Code ·
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Gal_a.c
Datenport */ #define CPORT *(char *)CENTPORT+1 /* Controlport: Bit 7 = BUSY-Leitung */ #endif #define SR_STROBE 0x01 /* Bits von Centronics-port */ #define SR_CLOCK 0x02 #define SR_DATEN 0x04 #define GAL_STROBE 0x08 /* Programmierimpuls und Aulesen, via Latch */ #define GAL_SDIN 0x10 #define GAL_CLOCK 0x20
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2018-07-21_SP2-100_MulDiv_Hauptbaugruppe_Schaltplan.pdf
U40E U46E mem_d15 alu_in_A4 2 9 F4 74F194 G 74F194 G 74F194 74S05 74S05 A7 B7 VCC alu_in_A5 23 A0 Q0 10 F5 2 2 2 11 10 F4 11 10 mem_d16 alu_in_A6 A1 Q1 F6 SR SR SR C7 21 A2 Q2 11 alu_in_A7 19 A3 Q3 13 F7 F4 3 A QA 15 F4 3 A QA 15 F4 3 A QA 15 U40F U46F mem_d17 A8 B8 mem_d18 F5 4 B QB 14 F5 4 B QB 14 F5
in „Space Age 2 der 32Bit MIPS Rechner in TTL“ · Projekte & Code ·
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Gedan---.asm
SPH,ZH Ldi sr16,0x00 ; Eigentliches Arbeits-Register. Ldi sr19,0x00 ; Null-Register. Ldi sr20,0xFF ; FF-Register. ; ; Also, Port A und C muß komplett als Ausgänge definiert werden. out ddra,sr20 out ddrc,sr20 ; ;
in „Ansteuerung von 2 kaskadierten Ls259 (DL259) mit AtMeg8515.“ · Mikrocontroller und Digitale Elektronik ·
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Lcdtreiberf_r_ks.txt
ACC push PSW push 7 mov A,7 push ACC swap A anl A,#0fh ; High-Nibble ausmaskieren clr C ; subb A,#10 ; jc M_Pr_BCD_ok1 ; add A,#7 M_Pr_BCD_ok1: add A,#('0'+10) mov 7,A lcall _printchar ;high-Nibble fertig. ; pop ACC ; anl A,#0fh ; low-Nibble ausmaskieren clr C ; subb A,#10 ; jc M_Pr_BCD_ok2 add A,#7
in „LCD 4x20 treiberproblem“ · Mikrocontroller und Digitale Elektronik ·
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AN-H65.pdf
than the Feedback OCP threshold. Otherwise OCP may not trigger in the event V OUT of a transient. SR10 OUT 400kΩ Rectification D6 The SR10 may configured with a full-wave rectifier or a half- wave rectifier. 50kΩ D12 Full-wave 25kΩ R D24 LIM C D RFB1 S 1-4 25kΩ DOUT VIN VOUT FB RFB2 SH OUT V V V x D6 1.20V
in „20 V AC bis 70 V AC --> 5 V DC“ · Analoge Elektronik und Schaltungstechnik ·
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NE_SA612.pdf
4.5V U 5.25 R I C F Y 2.50 S 5.00 L O P 2.25 N 4.75 U S 2.00 4.50 1.75 4.25 4.00 1.50 –40 –30 –20 –10 0 10 20 30 40 50 60 70 80 90 –40 –30 –20 –10 0 10 20 30 40 50 60 70 80 90 O O TEMPERATURE C TEMPERATURE C SR00108 SR00111 Figure 10. I CC vs Supply Voltage Figure 13. Noise Figure RF1= 45MHz, IF = 455kHz
in „Mischer SA612“ · Mikrocontroller und Digitale Elektronik ·
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Abdel-Rahman_Osama_A_200705_PhD.pdf
output filter is charged and the input power is delivered to the output. P S C 1 j1 V in iLr M Io A Lr SR L C r D I SR CjSR o S N ART cell < Mode 9 > Fig.2.6 i 33 Mode 10 (t < t < t ): At t = t , the switch S turns off, the filter inductor charges the junction 9 10 9 1 capacitance C and discharges C j1 jSR. P S1 C j1 V in Lr M Io A Lr L iSR C r D SR I CjSR o S N ART cell < Mode 10 > Fig.2.6 j Mode 11 (t < 10< t ): 11 When the junction capacitance voltage reaches zero, the SR body diode conducts carrying the output inductor current, which
in „Welche Schaltfrequenz bei Step-Down EMV-günstig?“ · Analoge Elektronik und Schaltungstechnik ·
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About_Lock_In_Amplifiers__SRS-Artikel_.pdf
of the gain (AC versus DC) is set by the dynamic reserve. Minimum Dynamic Reserve Input Noise The SR810, SR830 and SR850 always have a minimum amount of dynamic reserve. This minimum reserve changes The input noise of the SR810, SR830 or SR850 signal with the sensitivity (gain) of the instrument. At
in „AD630 Lock In Verstärker board, DC Offset am Ausgang“ · Analoge Elektronik und Schaltungstechnik ·
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src-hardware-gwinstek-gds-800-protocol.c
protocol.h" #include <math.h> #include <string.h> #define ANALOG_CHANNELS 2 #define VERTICAL_DIVISIONS 10 static int read_data(struct sr_dev_inst *sdi, struct sr_scpi_dev_inst *scpi, struct dev_context *devc, int data_size) { int len; len = sr_scpi_read_data(scpi, &devc->rcv_buffer[devc->cur_rcv_buffer_position
in „Wittig(welec) DSO W20xxA Open Source Firmware (Teil5)“ · Mikrocontroller und Digitale Elektronik ·
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main.c
======================================================================= void HcSr04StartMeasure(void) { HC_SR04_PORT |= HC_SR04_TRIGGER; // set hi _delay_us(10); HC_SR04_PORT &= ~HC_SR04_TRIGGER; // set low HcSr04Status = enHcSr04StatusMeasuring; } // =============================
in „HC SR-04 Ultraschallsensor (fertiger Code im Anhang)“ · Mikrocontroller und Digitale Elektronik ·
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SA612A.pdf
4.5V U 5.25 R I C F Y 2.50 S 5.00 L O P 2.25 N 4.75 U S 2.00 4.50 1.75 4.25 4.00 1.50 –40 –30 –20 –10 0 10 20 30 40 50 60 70 80 90 –40 –30 –20 –10 0 10 20 30 40 50 60 70 80 90 O O TEMPERATURE C TEMPERATURE C SR00108 SR00111 Figure 10. I CC vs Supply Voltage Figure 13. Noise Figure RF1= 45MHz, IF = 455kHz
in „Colpitts Crystal Oscillator für 10MHz?“ · Mikrocontroller und Digitale Elektronik ·
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SA612A.PDF
4.5V U 5.25 R I C F Y 2.50 S 5.00 L O P 2.25 N 4.75 U S 2.00 4.50 1.75 4.25 4.00 1.50 –40 –30 –20 –10 0 10 20 30 40 50 60 70 80 90 –40 –30 –20 –10 0 10 20 30 40 50 60 70 80 90 O O TEMPERATURE C TEMPERATURE C SR00108 SR00111 Figure 10. I CC vs Supply Voltage Figure 13. Noise Figure RF1= 45MHz, IF = 455kHz
in „Langwellen Minimal SDR mit sa612 und SI5351“ · HF, Funk und Felder ·
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BTN7970_DS_11.pdf
HS) 0.5 1 1.6 RSR= 0 Ω – 2 – RSR= 5.1 kΩ 2 5 11 R = 51 kΩ SR 5.2.11 Slew Rate HS off1) -ΔV OUT/ V/µs t 6.8 10.8 21.6 R = 0 Ω f(HS) SR – 5.4 – RSR= 5.1 kΩ 1 2.2 5.4 RSR= 51 kΩ 5.2.12 Switch off Delay Time HS tdf(HS) µs 1 2.4 3 RSR= 0 Ω – 3.4 – R = 5.1 kΩ SR 3 10
in „Wärmeableitung Motortreiber BTN7970B (PG-TO263-7-1)“ · Mikrocontroller und Digitale Elektronik ·
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BTN7970.pdf
HS) 0.5 1 1.6 RSR= 0 Ω – 2 – RSR= 5.1 kΩ 2 5 11 R = 51 kΩ SR 5.2.11 Slew Rate HS off1) -ΔV OUT/ V/µs t 6.8 10.8 21.6 R = 0 Ω f(HS) SR – 5.4 – RSR= 5.1 kΩ 1 2.2 5.4 RSR= 51 kΩ 5.2.12 Switch off Delay Time HS tdf(HS) µs 1 2.4 3 RSR= 0 Ω – 3.4 – R = 5.1 kΩ SR 3 10
in „Halbbrücke BTN7970 Motorstromüberwachung“ · Mikrocontroller und Digitale Elektronik ·
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npl30d.vhd
(3 downto 0); signal wakeup_sr : std_logic_vector(3 downto 0); signal fbusy_sr : std_logic_vector(3 downto 0); signal cninval1_sr : std_logic_vector(3 downto 0); signal cninval2_sr : std_logic_vector(3 downto 0); signal mcd1_sr :
in „Probleme bei der Umstellung von Verilog nach VHDL“ · FPGA, VHDL & Co. ·
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npl30d.vhd
(1 downto 0); signal wakeup_sr : std_logic_vector(1 downto 0); signal fbusy_sr : std_logic_vector(1 downto 0); signal cninval1_sr : std_logic_vector(1 downto 0); signal cninval2_sr : std_logic_vector(1 downto 0); signal mcd1_sr :
in „Probleme bei der Umstellung von Verilog nach VHDL“ · FPGA, VHDL & Co. ·
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Listing_1.txt
INPUT IMPEDANCE OP AMP MODEL * .SUBCKT OPAMPMODH IN+ IN- V+ V- OUT + PARAMS: AV=100K VRP=1 VRN=1 RO=10 IQ=0.5m VOS=0 RIN=1E10 + CIN=2p ILP=50m ILN=50m CMR=100K SR=1MEG FU=1MEG PM=60 * X_XIQ V+ V- ILOADB PARAMS: ID={IQ} VD=0.5 V_VOS IN+ $N_0001 DC {VOS} G_GI+ V+ 1_VR 1_IOP 0 1 G_GI- 1_VR V- 1_ION 0 1 E_ABM23
in „Übertragung eines Pspice-Makromodells(OpV) in LTSpice“ · Mikrocontroller und Digitale Elektronik ·
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npl30d.vhd
_irq, CPLD_CLK) begin if CPLD_CLK = '1' and CPLD_CLK'event then if (reset0_irq(0) = '0') then ccts_sr0 <= '0'; ccts_sr1 <= '0'; else ccts_sr0 <= ccts_in; ccts_sr1 <= ccts_sr0; end if; end if; end process; sl_reg_l(0) <= ccts_sr1; -----------------------------------------------------------------------
in „Probleme bei der Umstellung von Verilog nach VHDL“ · FPGA, VHDL & Co. ·
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pmc.h
6) #define PMC_IER_PCKRDY0 (1 << 8) #define PMC_IER_PCKRDY1 (1 << 9) #define PMC_IER_PCKRDY2 (1 << 10) #define PMC_IER_MOSCSELS (1 << 16) #define PMC_IER_MOSCRCS (1 << 17) #define PMC_IER_CFDEV (1 << 18) /* PMC Status Register */ #define PMC_SR_MOSCXTS (1 << 0) #define PMC_SR_LOCKA (1 << 1) #define PMC_SR_MCKRDY (1 << 3) #define PMC_SR_LOCKU (1 << 6) #define PMC_SR_OSCSELS (1 << 7) #define PMC_SR_PCKRDY0 (1 << 8) #define PMC_SR_PCKRDY1 (1 << 9) #define PMC_SR_PCKRDY2 (1 << 10) #define PMC_SR_MOSCSELS (1 << 16) #define PMC_SR_MOSCRCS
in „SAM3X: HardFault bei Wechsel der Taktquelle“ · Mikrocontroller und Digitale Elektronik ·
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PS2_Keyboard_Ctrl.vhd
process(Clock) begin if(rising_edge(Clock)) then -- Eintakten des asynchronen PS/2-Signals PS2_DataSR <= PS2_DataSR(0) & PS2_Data; PS2_ClockSR <= PS2_ClockSR(0) & PS2_Clock; -- Flankenerkennung am PS/2-Clock if(PS2_ClockSR = "10") then Input_Buffer <= PS2_DataSR(1) & Input_Buffer(10 downto 1); end if
in „PS/2 im FPGA“ · FPGA, VHDL & Co. ·
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PS2_Keyboard_Ctrl.vhd
process(Clock) begin if(rising_edge(Clock)) then -- Eintakten des asynchronen PS/2-Signals PS2_DataSR <= PS2_DataSR(0) & PS2_Data; PS2_ClockSR <= PS2_ClockSR(0) & PS2_Clock; -- Flankenerkennung am PS/2-Clock if(PS2_ClockSR = "10") then Input_Buffer <= PS2_DataSR(1) & Input_Buffer(10 downto 1); end if
in „PS/2 im FPGA“ · FPGA, VHDL & Co. ·
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BCD_Counter.vhd
is port( reset : in std_logic; clk : in std_logic; btn_up : in std_logic; btn_dn : in std_logic; bcd10 : out std_logic_vector(3 downto 0); bcd1 : out std_logic_vector(3 downto 0) ); end test; architecture beh of test is signal sr_up : unsigned (3 downto 0) := "0000"; -- Schieberegister für Flankenerkennung
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f_mess.c
interrupts TIM8->CR1 |= TIM_CR1_CEN; // T8 starten } void TIM8_UP_TIM13_IRQHandler(void) { if(TIM8->SR & TIM_SR_UIF) { // nur bei überläufen von T8 TIM8->SR = ~TIM_SR_UIF; ueberlauf++; mess_dauer++; } } void TIM8_CC_IRQHandler(void) { static uint32_t anzahl, anzahl_alt, zeit, zeit_alt, zeit_1, zeit_2;
in „Frequenz- und Pulsweitenmessung mit STM32F407“ · Projekte & Code ·
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innoswitch3-ep_family_datasheet.pdf
......100 mA FWD Pin Voltage ......................................................-1.8 V to 150 V 10 10. See Figure 30. FB Pin Voltage ..............................................................-0.3 V to 6 V SR Pin Voltage .............................................................-0.3 V to 6 V
in „Fritz Repeater 2400“ · Analoge Elektronik und Schaltungstechnik ·
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pseuzufgen3.vhd
Q_OUT16(9) <= QINT16(8) xor LAST_BIT; -- der Ausgang des neunten SR wird mit dem Ausgang XOR verknüpft end if; if XOR_EN(10) = '1' then Q_OUT16(10) <= QINT16(9) xor LAST_BIT; -- der Ausgang des zehnten SR wird mit dem Ausgang XOR verknüpft end if; if XOR_EN(11) = '1' then Q_OUT16(11) <= QINT16(10) xor LAST_BIT; -- der Ausgang des elften SR wird mit dem Ausgang XOR verknüpft end if; if XOR_EN(12) = '1' then Q_OUT16(12) <= QINT16(11) xor LAST_BIT; -- der Ausgang des zwölften SR wird mit dem Ausgang
in „flexibler Pseudozufallszahlengenerator! was mache ich falsch?“ · FPGA, VHDL & Co. ·
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FixpointApfel.c
'.'; uint16_t p = nk * 10; uint16_t t = 1024; while (p < t) { str [len++] = '0'; p *= 10; } itoa (snk, str + len, 10); } return result; } fixpoint int16ToFixpoint (int16_t i) { return ((fixpoint) i) << pixpointFractShift; } fixpoint
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NF-Generator-407.c
Verarbeitung des Zwischenwertes int32_t vz=0; // nach Quadrieren Vorzeichen wiederherstellen uint32_t sr_temp = TIM9->SR; // Int-Status sequentiell abarbeiten // Ausgangsfrequenz erzeugen/anpassen if(sr_temp & TIM_SR_CC1IF) { // Compare mit CCR1 TIM9->SR = ~TIM_SR_CC1IF; // Flag löschen if(trigger_pw) {
in „Frequenz Erzeugung mit avr“ · Mikrocontroller und Digitale Elektronik ·
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INN3977CQ.pdf
Typ Max Units T J -40 °C to 125 °C (Unless Otherwise Specified) Synchronous Rectifier @ T =J25 °C SR Pin Drive Voltage V SR 4.4 V SR Pin Voltage VSR(TH) -3.3 mV Threshold T J 25 °C 135 165 195 SR Pin Pull-Up Current ISR(PU) mA 100 230 SR Pin Pull-Down T J 25 °C 260 298 336 Current ISR(PD) mA 186 435
in „Frage zu PowerInc INN3977CQ“ · Analoge Elektronik und Schaltungstechnik ·
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wiznet_driver.h
S_INTE_REG 0x02 // interrupt register address (IR) #define S_STATUS_REG 0x03 // status register address (SR) #define S_SOURCE_PORT 0x04 // 0x04 to 0x05 (0..1) #define S_DESTINATION_MAC_ADDRESS 0x06 // 0x06 to 0x0B (0..5) #define S_DEST_IP_ADDR 0x0C // 0x0C to 0x0F (0..3) #define S_DEST_PORT 0x10 // 0x10 to
in „Problem bei Übergabe von struct & Pointer“ · Mikrocontroller und Digitale Elektronik ·
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Philips_AN1981_-_New_Low-Power_Single_Sideband_Circuits__10-1997_.pdf
NETWORK HEF4053 FIGURE 15 CIRCUIT SA5534 DETECTOR SA5534 USB 9.5K DETECTOR 1K AMPLITUDE BALANCE POTS 10K LSB THE THREE 1K 9.5K 10K SWITCH CONTROL – PINS ARE TIED SSB TOGETHER FOR AUDIO ONE BIT + OUTPUT SIDEBAND SELECT FUNTION SA5534 SR00809 Figure 14. Sideband Select Switching Function 10K 10K 10K ANALOG SWITCH 10K 10K 10K BUFFERS – – – – 1000pF 1000pF 1000pF INPUT + + + + A 16.2K 118 511K 10K 10K 10K 10K 10K 10K – – – 1000pF 1000pF – 1000pF INPUT B + + + + 54.9K 237K 1.74M SR00810 Figure 15. 1997 Oct 29 4–8 Philips
in „3rd-OT-Oszillator mit NE602 (an Pin 6 und 7)“ · HF, Funk und Felder ·
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Jesper_1x1536x8_9.txt
andi temp, 0xF8 ; mask Bit0...2 (prescaler und reserve-bit) out PORTB,temp sbi portB,0 cpi temp, TW_SR_SLA_ACK ; x60 breq TWSI_TW_SR_SLA_ACK cpi temp, TW_SR_ARB_LOST_SLA_ACK ; x68 breq TWSI_END cpi temp, TW_SR_GCALL_ACK ; x70 breq TWSI_END cpi temp, TW_SR_ARB_LOST_GCALL_ACK ; x78 breq TWSI_END cpi temp, TW_SR_DATA_ACK ; x80 breq TWSI_TW_SR_DATA_ACK cpi temp, TW_SR_DATA_NACK ; x88 breq TWSI_END cpi temp, TW_SR_GCALL_DATA_ACK ; x90 breq TWSI_END cpi temp, TW_SR_GCALL_DATA_NACK ; x98 breq TWSI_END cpi temp,
in „DDS normal ?“ · Mikrocontroller und Digitale Elektronik ·
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mic920.pdf
V± = ±9V 90 90 100 80 80 70 70 )80 ) ) d (60 ( 60 R60 R50 R 50 R R R P C40 C 40 40 30 30 20 20 20 10 10 0 0 0 0.1 1 10 100 1k 10k 11001011k0 110k0 1 0k111M0 10M10 101000 11k0 10k 1 0k0x11M10 10M10 FREQUENCY (Hz) FREQUENCY (Hz) FREQUENCY (kHz) Positive Slew Rate Negative Slew Rate Positive Slew Rate
in „LTspice - OPAmp Modell aus Datenblatt“ · Analoge Elektronik und Schaltungstechnik ·
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fixapfel.cpp
+) { if (nkBuf [m] == 0) { nkBuf [m] = '0'; nkBuf [m+1] = 0; } } int16_t r = atoi (nkBuf); int16_t sr = r; if (sr != 0) { if (sr < 0) { sr = -sr; } sr = (sr*17)/16; //--- 500 -> 512 --- sr = (sr*28)/29; //--- gut genug so --- if (sr > 1023) { sr = 1023; } else if (sr < 1) { sr = 1; } f |= sr; } } if
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marantz-sr8200-9200-service-manual.pdf
m m RL10 0 GND 10/50V B L/ 6 7 V V V SR8200U,S GND u u 9 GND GND GND GND RL33 4 p C1 L L 4 5 GNDVCR1 SR8200ONLY 10/50V GND E 1 9 220 L 0 C C GND E F N D C B A L L JL04 GND VCR1 Jumper CL29 +5VL GND 2 K QL22 L2
in „MARANZ RC3200 datenkabel belegung gesucht“ · Mikrocontroller und Digitale Elektronik ·
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main.c
volatile uint32_t *) (SPI1 + 0x0))) #define SPI1_CR2 (*((volatile uint32_t *) (SPI1 + 0x4))) #define SPI1_SR (*((volatile uint32_t *) (SPI1 + 0x8))) #define SPI1_DR (*((volatile uint32_t *) (SPI1 + 0xC))) #define SPI1_CRCPR (*((volatile uint32_t *) (SPI1 + 0x10))) #define SPI1_RXCRCR (*((volatile uint32_t *
in „SPI auf STM32F103 - kein Signal“ · Mikrocontroller und Digitale Elektronik ·
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i2c.cpp
1: { err_cnt=0; I2CX->CR1|=I2C_CR1_STOP; while((I2CX->SR1 & I2C_SR1_RXNE) == 0) //ob daten empfangen { if (++err_cnt == I2C_TIMEOUT) return I2CERR_READ_TIMEOUT; DelayuS(); } data[0] = I2CX->DR; // Warten bis Stop-Condition err_cnt=0; while((I2CX->SR2 & I2C_SR2
in „CubeMX und HAL - I2C hängt sich auf“ · Mikrocontroller und Digitale Elektronik ·
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DiskOnChip_Mil._DS_Rev2.1.pdf
assertion of RSTIN# occurs during a flash erase cycle, this time could reach a maximum of 500 µS. 93-SR-002-00-8L Rev. 2.1 21 DiskOnChip Millennium Data Sheet 10. Mechanical Specifications 10.1.Thermal Characteristics Thermal characteristics for each of the package options are shown in the following table
in „Pollin Netbox“ · Mikrocontroller und Digitale Elektronik ·
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Baustelle.txt
= 0x18;(11000 Bit 4 > table) .equ RectangularMode = 0x11;(10001 Bit 4 SineTable) .equ SineMode = 0x10;(10000 Bit 4 > table) .equ SawtoothMode = 0x04;(00100 Bit 4 no table) .equ NoiseMode = 0x02;(00010 Bit 4 no table) .equ OffMode = 0x00 ; ; ; TWI Slave Receiver Codes .equ TW_SR_SLA_ACK = 0x60;(SLA+W
in „DDS normal ?“ · Mikrocontroller und Digitale Elektronik ·
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Ereignisse_80x.c
stabiles Signal // und Zaehlen positiver Aenderungen // Abfrageintervall nach Bedarf per ISR #define SR_BITS 8 #define SR_ANZAHL 10 #define ZAEHLER_ANZAHL (SR_ANZAHL * SR_BITS) uint32_t zaehler[ZAEHLER_ANZAHL]; // Zaehler in Software uint8_t sr_byte_neu[SR_ANZAHL]; // aktuelles Eingangsmuster uint8_t sr_byte_alt
in „Viele Kippwaagen, wie zählen?“ · Mikrocontroller und Digitale Elektronik ·
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i2s_data_interface.vhd
rising_edge(clk) then new_sample <= '0'; if bclk_delay(bclk_delay'high-1 downto bclk_delay'high-2) = "10" then -- is there a rising edge two cycles ago? If so the data bit is validand we can capture a bit sr_in <= sr_in(sr_in'high-1 downto 0) & i2s_d_in_last; end if; if bclk_delay(1 downto 0) = "10" then
in „Genesys 2 (Xilinx Kintex 7): Audio-Codec Implementierung und Filteranbindung“ · FPGA, VHDL & Co. ·
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i2s_data_interface.vhd
rising_edge(clk) then new_sample <= '0'; if bclk_delay(bclk_delay'high-1 downto bclk_delay'high-2) = "10" then -- is there a rising edge two cycles ago? If so the data bit is validand we can capture a bit sr_in <= sr_in(sr_in'high-1 downto 0) & i2s_d_in_last; end if; if bclk_delay(1 downto 0) = "10" then
in „Genesys 2 (Xilinx Kintex 7): Audio-Codec Implementierung und Filteranbindung“ · FPGA, VHDL & Co. ·
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i2s_data_interface.vhd
rising_edge(clk) then new_sample <= '0'; if bclk_delay(bclk_delay'high-1 downto bclk_delay'high-2) = "10" then -- is there a rising edge two cycles ago? If so the data bit is validand we can capture a bit sr_in <= sr_in(sr_in'high-1 downto 0) & i2s_d_in_last; end if; if bclk_delay(1 downto 0) = "10" then
in „Genesys 2 (Xilinx Kintex 7): Audio-Codec Implementierung und Filteranbindung“ · FPGA, VHDL & Co. ·
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i2s_data_interface.vhd
rising_edge(clk) then new_sample <= '0'; if bclk_delay(bclk_delay'high-1 downto bclk_delay'high-2) = "10" then -- is there a rising edge two cycles ago? If so the data bit is validand we can capture a bit sr_in <= sr_in(sr_in'high-1 downto 0) & i2s_d_in_last; end if; if bclk_delay(1 downto 0) = "10" then
in „Genesys 2 (Xilinx Kintex 7): Audio-Codec Implementierung und Filteranbindung“ · FPGA, VHDL & Co. ·
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i2s_data_interface.vhd
rising_edge(clk) then new_sample <= '0'; if bclk_delay(bclk_delay'high-1 downto bclk_delay'high-2) = "10" then -- is there a rising edge two cycles ago? If so the data bit is validand we can capture a bit sr_in <= sr_in(sr_in'high-1 downto 0) & i2s_d_in_last; end if; if bclk_delay(1 downto 0) = "10" then
in „Genesys 2 (Xilinx Kintex 7): Audio-Codec Implementierung und Filteranbindung“ · FPGA, VHDL & Co. ·
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i2croutines.c
--------------------------------------------*/ #include "i2croutines.h" #include "../Std_lib/stm32f10x_dma.h" #include "../Std_lib/stm32f10x_gpio.h" #include "../Std_lib/stm32f10x_i2c.h" #include "../Std_lib/stm32f10x_rcc.h" /** @addtogroup Optimized I2C examples * @{ */ /* Private typedef ----------
in „stm32 Cortex I2C : Master zieht SCL auf Masse“ · Mikrocontroller und Digitale Elektronik ·
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SHIFT_DEMO.asm
5 ;else sr_data_lo ; 74x595 SR_DATA = 0 nop sr_shift_hi ;74x595 Shift Clock nop sr_shift_lo sbrc AH,4 ;if Bit 12 = 1 then sr_data_hi ; 74x595 SR_DATA = 1 sbrs AH,4 ;else sr_data_lo ; 74x595 SR_DATA = 0 nop sr_shift_hi ;74x595 Shift Clock nop sr_shift_lo sbrc AH,3 ;if Bit 11 = 1 then sr_data_hi ; 74x595 SR_DATA = 1 sbrs AH,3 ;else sr_data_lo ; 74x595 SR_DATA = 0 nop sr_shift_hi ;74x595 Shift Clock nop sr_shift_lo sbrc AH,2 ;if Bit 10 = 1 then
in „Schieberegisteransteuerung mit einem 8515“ · Projekte & Code ·
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F2_messung.c
TIM_DIER_UIE; // und Interrupt freigeben } } void TIM6_DAC_IRQHandler(void) // Aufruf mit 1 kHz { if(TIM6->SR & TIM_SR_UIF) { // nur bei überläufen von T16 TIM6->SR = ~TIM_SR_UIF; F2_mess_dauer++; // Messzeit erfassen __ISB(); // gelöschtes Flag abwarten } } // lokal erzeugte Testfrequenz 10 MHz per PWM an PD12
in „lineare Regression bei reziprokem Frequenzzähler wirkungslos?“ · Mikrocontroller und Digitale Elektronik ·
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ds1820.asm
; nein - sofort ende mov temp5,temp4 ; last discrepancy = last zero brtc iw_sr_10 ; soll adresse überhaupt gespeichert werden? sbiw yl,8 ; nein, dann iwire-adress- und -zielspeicher wieder auf die gerade sbiw zl,8 ; empfangene adresse zurückbewegen rjmp iw_sr_12 ; jetzt noch test ob überhaupt weiter gesucht werden soll iw_sr_10: cpi temp6,0 ; ok, eine richtige adresse gefunden, ist es die erste? brne iw_sr_11 sbiw yl,8 ; ja, dann den adresszeiger auf die vorige adresse setzen iw_sr_11: inc temp6 ; merke - eine adresse mehr
in „mehere ds1820 an einem bus“ · Mikrocontroller und Digitale Elektronik ·
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DE_1331_SR_DFF.pdf
DC-Kleinstmotoren 3,8 mNm Edelmetallkommutierung 5 W Serie 1331 ... SR Werte bei 22°C und Nennspannung 1331 T 006 SR 012 SR 024 SR 1 Nennspannung UN 6 12 24 V 2 Anschlusswiderstand R 2,83 13,7 52,9 Ω 3 Wirkungsgrad, max. η max. 81 80 80 % 4 Leerlaufdrehzahl n0 10 600 9
in „Faulhaber Motor- finde leider keine Daten“ · Analoge Elektronik und Schaltungstechnik ·