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Parallax Propeller
enthaltenen Interpreter ausgeführt wird. Im internen ROM sind noch weitere Daten, wie z. B. Fonts, 16-Bit Sinus- und Log-Tabellen enthalten. Der Sourcecode für den Spin-Intepreter ist hier frei verfügbar. Eine kostenlose IDE ("Propeller Tool") kann von der Parallax-Webseite runtergeladen werden, sie ist sowohl
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Informationssammlung Wechselrichter
mikrocontroller.net Frequenzumrichter mit Raumzeigermodulation - mikrocontroller.net Projekt Sinuswechselrichter 600 W Patente zum Thema. Patentschriften (Achtung, Liste unvollständig). Die Vollschrift als PDF ist jeweils unter *Original document* verfügbar. (Auch komplett) DE19843692 ??? Patentklassen
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Funktionsgenerator
der Steigung der Dreieckspannung, ab. Um aus dem so erzeugten Dreiecksignal eine angenäherte Sinusschwingung zu gewinnen, wird ein Sinusfunktionsnetzwerk verwendet. Damit wird die Eingangsspannung mit Hilfe von Dioden in mehrere Abschnitte "zerlegt", die jeweils unterschiedliche, durch Spannungsteiler
besteht darin, einen Sinus-Generator zu verwenden und mittels Komparator zunächst eine Rechtecksapnnung und dann mit einem Integrator das Dreieck zu generieren. Digitaler Funktionsgenerator. Moderne digitale Funktionsgeneratoren
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Schnelle 32Bit-Integer Sinusberechnung
gleicher Genauigkeit funtioniert natürlich auch für Winkel mit 1-2 Nachkommastellen: Source code: Sinus.zip Quellen und Links. Fast sine function Sinusberechnung für 32Bit-Integer Diskussion über die Taylor-Reihe, Beitrag von waldo Alternative Interpolation, Artikel: Sinus berechnung Genaue Iteration für avr-gcc, Artikel: Sinus und Cosinus (CORDIC) Lineare Interpolation für avr-gcc: Sinus und Cosinus (Lineare Interpolation) Autor: Marten Petschke
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Netzspannung
Widerstand die gleiche Leistung umsetzt wie eine betragsgleiche Gleichspannung. Der Spitzenwert der Sinuskurve erreicht dabei das -fache dieses Werts. Wenn man eine Wechselspannung gleichrichtet und durch einen Kondensator glättet, lädt dieser sich auf diesen Spitzenwert auf: Dazu kommt dann noch die Spannungstoleranz
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Wechselrichter
Teilt man die 20msec einer 50 Hz Periode durch 62,5µsec ergeben sich 320 Pulsperioden pro 50Hz Sinuswelle. Bei einer Taktfrequenz des Controllers von 20MHz und einem Timer ohne Vorteiler ergeben sich 20MHZ / 16KHz = 1250 Timertakte. Das heißt der Timer muss bis 1250 hoch zählen um die 62,5µsec einzuhalten
PWG Genrators verbunden. Die Spannung am Ausgang der H-Brücke. Noch ist das ziemlich weit von einem Sinus entfernt. Filter. Der LCL-Filter glättet die PWM zu einem Sinus-Signal. Signal im Leerlauf. Signal unter Last Auf dem Scope-Bild sieht man, wie stark der einst schöne Sinus verzerrt wird, wenn etwas
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Digitaler LaPlace-Funktionsgenerator im FPGA
Ansonsten würde ein mehrkanaliges Oszilloskop taugen, um die Signale zu scannen. Erzeugung. Die Sinuswellen selbst wurden aufgrund der benötigten Genauigkeit in diesem Projekt aus einer interpolierten, mehrfach abgetasteten Sinustabelle (phase dithering) gemäß dem DDS-Prinzip gewonnen, nochmals gefiltert
verwendet. Diese erfordern mehr Rechenaufwand, liefern aber besonders bei hohen Frequenzen den besseren Sinus. Für einfache Operationen weit unterhalb der Abtastfrequenz reicht eine Vervielfachung der Frequenz mittels Multiplikation und Bereinigung um den Gleichanteil. Diese Methode eignet sich auch für die
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Oszillator
verschiedene Typen von Oszillatoren mit sehr verschiedenen Eigenschaften. So gibt es Oszillatoren, welche Sinus- oder Rechtecksignale erzeugen, manche auch Sägezahn oder Dreieck. Im Prinzip besteht jeder Oszillator aus einem Verstärker (Transistorstufe, Operationsverstärker, digitaler Schalter oder Speicher)
Vertreter ist der NE555. Dieser liefert ein Rechtecksignal. Mit einem Wien-Oszillator kann man ein Sinussignal erzeugen. Vorteile: einfacher Aufbau robust und anschwingsicher geringste Einschwingzeit (typ. 1 Takt) einfach in ICs integrierbar, z. B. Mikrocontroller Nachteile: oft ungenau und stark temperaturabhängig
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VHDL Testbench
instanziiert und die Testbench erzeugt nur ein Taktsignal (clk) und ein Resetsignal. Die Ausgänge (sinus, saegezahn, rechteck) von mini_dds werden auf entsprechend benannte Signale geführt. Nun das Modul, welches die eigentliche Arbeit verrichtet: Hier wird ein asynchroner Reset zum Initialisieren verwendet. "phase" stellt einen Zähler dar. Aus diesem werden die weiteren Signale generiert. Das Sinussignal wird aus einer Tabelle erzeugt, der Zähler selbst ist ein Sägezahn und das oberste Bit des Zählers wird als Rechtecksignal verwendet. Bei diesem Modul wurde bewußt ieee.numeric_std.all zum Rechnen
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Entwurf: Spektralanalyse mit der FFT
und Phase der entsprechenden Sinusschwingung repräsentiert. Grafisch lässt sich die FFT so interpretieren, dass ein orthogonales Koordinatensystem bestehend aus Sin/Cos auf das Signal angewendet wird, um dessen Vektoranteile in diesem Koordinatensystem
kurz PSD (Power Spectral Density). (Plot Zeitsignal -> PSD) Fensterung. (Plot 1. abgeschnittener Sinus, 2. mit Fensterung) Realität: stochastische Signale. In realen Anwendungen hat man meist kein Signal mit einer definierten Form wie einen Sinus, sondern Signale von denen man nicht weiss wie sie aussehen
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USB Oszilloskop
Handyscope) ProbeScope (Handgerät) (LPT) (PCI,5GS) Cleverscope PCSU 1000 Logicanalyser, Test Generator(Sinus,Dreieck,Rechteck,Noise), Frequenzzähler, Spektrumanalysator, Logikanalysator Anforderungen. galvanische Trennung vom PC 2 Kanäle mit freier Triggerwahl min. 10% Pretriggerspeicher Meßbereich ohne Teilertastkopf
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Analog-IO mit digitalen Bausteinen
aus Integer-Werten überführt werden kann. Auch möglich ist die Benutzung einer hochfrequenten Sinuswelle, wenn deren Frequenz und gfs. Phase bekannt ist und die mit einem steilen Notchfilter analog abgezogen oder intern per Signalverbeitung verrechnet wird. In FPGAs ist eine solche Lösung sehr leicht
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Sinus Tabelle
von kruemeltee Da die Sinusberechnung auf einem Mikrocontroller sehr zeitintensiv ist, kann man in vielen Fällen auch mit einer festen Sinustabelle arbeiten, aus welcher die Werte geholt werden. Natürlich lässt sich dieses Prinzip
int-Wertebereich inklusive der negativen Zahlen durch Ignorieren der Bits 15..10. Siehe auch. AVR Arithmetik: Sinus und Cosinus (Lineare Interpolation) AVR Arithmetik: Sinus und Cosinus (CORDIC) Digitale Sinusfunktion
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Pulsdichtemodulation
Regelung den Istwert somit permanent um den Sollwert herum und zeichnet das eingeprägte Signal (hier ein Sinus) nach. Version mit ungeregeltem idealen Integrator. Praktisch gibt es aber einige Probleme: Infolge der Verluste der Schaltung und des teilweise nichtlinearen Verhaltens der Bauelemente (speziell des
Am Ausgang reicht ein einfaches, analoges 2-stufiges Tiefpassfilter, um einen recht ansehnlichen Sinus zu generieren. In einem FPGA z. B. sind damit über einen einzelnen Ausgang 200 MHz / 40 = 5 MHz direkt zu erzielen. Mit nur etwas mehr Aufwand lässt sich ein Dreieck variabler Frequenz erzeugen: Man
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Sinusgenerator mit IIR-Filter
Ein Sinusgenerator wird heute in digitaler Technik üblicherweise nach dem DDS-Verfahren aufgebaut. Näherungsverfahren für den Sinus sind noch eine vergleichbare Alternative sowie das Glätten eines Rechtecks oder
und deren Interaktion mit elektronischen Regelungen perfekt ab. Thema im Forum. iir Filter als Sinusgenerator Sinuserzeugung in VHDL FPGA Größe ausreichend für komplexen FM Synthesizer Literatur. 3. Digitale Signalverarbeitung: Bausteine, Systeme, Anwendungen, S. 51-52 "Einfacher Sinus-Cosinus-Generator
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AVR-CORDIC
Kartesische Koordinaten, sin, cos, tan, cot Der CORDIC kann so auch als Alternative zum DDS Sinusgenerator verwendet werden. Er braucht keine Tabelle, daher ist eine höhere Amplitudenauflösung von z. B. 16 Bit möglich. Es entsteht gleichzeitig eine Sinus- und Cosinusschwingung. linear vectoring. Division
iterations=16 _lAkkum hat 1 Vorzeichenbit, 7 Vorkomma- und 24 Nachkommabits, iterations=24 Sinus/Cosinusgenerator. Die iterative Näherung der Sinus und Cosinusfunktion folgt diesem Programmablauf, ähnlich der Darstellung im DDJ-Artikel von Mike Pashea, siehe Literaturangaben: Konvergenzbereich:: -1.7433
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DDS
PM), Frequency Shift Keying (FSK) und ähnliches mehr. Viele ICs sind mehrkanalig und liefern einen Sinus- und Cosinusausgang gleichzeitig. Siehe auch. Artikel. Digitaler Funktionsgenerator DDS basierter Funktionsgenerator mit AD5930 200MHz DDS-Generator FPGA Lab Digitale Sinusfunktion DDS-Signalgenerator_per_USB
Grundlagen Sinus mit DDS Nicht-Sinus DDS Sinustabelle mit 2 Geschwindigkeiten DDS AD9851 Synchronisierung Zwei 45kHz-Signale, 90° Phasenverschoben erzeugen Fraktionaler Teiler, 14:1 bis 524000:1 DDS im FPGA Suchen.
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Filter
eingehenden Datenstrom mit einer COS-Schwingung (im komplexen Fall auch zusätzlich mit der Sinus-Schwingung) und erhält eine Resonanz: Frequenzen im Datenstrom, die genau der Filterfrequenz entsprechen, werden vollständig durchgelassen. Frequenzen links und rechts davon mit zunehmender Abweichung der
Schaltungstechnik Fortsetzung / Erweiterung folgt... Links. Dezimation und Halbbandfilterung Sinusgenerator mit IIR-Filter Klangerzeugung mit IIR-Filter Anwendungen. Entfernen von Störsignalen aus einem Nutzsignal (z. B. bei einem Funkempfänger) Unterdrückung eines Wechselpannungsanteils Anti-Aliasing
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200MHz DDS-Generator
Übersicht. In diesem Projekt soll versucht werden, einen hochwertigen, aber trotzdem kostengünstigen Sinus-Generator mit einer maximalen Ausgangsfrequenz von 180MHz bis 200MHz auf Basis einer DDS zu bauen. Die Materialkosten sollen 200€ nicht überschreiten. Spezifikationen. 180MHz Option um mit Aliasfilter bis
behalten. Ggf. ist diesbezüglich eine Lösung mit einem Mischer und PLL vernünftiger (aber auch teurer). Sinus Ausgang Optional Rechteck Ausgang via Komparator DC-Offset? Ausgangspegel bis 23dBm, einstellbar Modularer Aufbau, damit Funktionen ergänzt oder weggelassen werden können Option zum Einspeisen eines
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230V
Wandlung erfolgt mit speziellen ADCs, welche eine interne galvanische Trennung bieten und das 50-Hz-Sinus-Signal in einen digitalen Datenstrom mit 3,3 V Ausgang übersetzen. Schaltungshinweise. Siehe dazu: Forumsbeitrag: Genauer Nulldurchgangsdetektor, galvanisch getrennt, Erhalt der Phaseninformation Forumsbeitrag
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AVR Arithmetik/Sinus und Cosinus (Lineare Interpolation)
Damit wäre ein Eingabeformat von 512=2 9 Inkrementen pro Grad zwar naheliegend (die Ableitung des Sinus/Cosinus ist höchstens 1), aus rechentechnischen Erwägungen unterteilen wir ein Grad jedoch nur in 256=2 8 Inkremente und kommen damit zum vorliegenden Eingabeformat. Genauigkeit. + Lineare Interpolation
Ergebnisse der linearen Interpolation per Konstruktion monoton: Im Intervall 0... /2 ist die Sinus-Funktion z. B. monoton wachsend, und das gilt auch für die hier berechneten Werte. Bei CORDIC sind die Ergebnisse "verrauscht", so daß es auch bei etwas größerer Eingabe zu einem kleineren Wert kommen kann