Hallo, guten Tag .
Ich möchte einen Art Gatterbaukasten haben zum Spielen in VHDL.
Hiermit wird schon etwas dargestellt:
1
libraryieee;
2
useieee.std_logic_1164.all;
3
useieee.numeric_std.all;
4
5
entitylogiis
6
7
port(
8
sw0:instd_logic;
9
sw1:instd_logic;
10
sw2:instd_logic;
11
sw3:instd_logic;
12
led:outstd_logic
13
);
14
endlogi;
15
16
architecturebehavioraloflogiis
17
18
signalsig1:std_logic;
19
signalsig2:std_logic;
20
signalsig3:std_logic;
21
22
begin
23
sig1<=sw0andsw1;
24
sig2<=sw2andsw3;
25
led<=sig1xorsig2;
26
endbehavioral;
Nun möchte dieses Gatterkonstrukt mehrmals einbinden für eine
Kettenreaktion. Wie kann man das machen?
Ich möchte mir eine Gattersammlung anlegen , die ich dann nach belieben
verbinden kann auch mit einem Takt.
danke.
Gruss
Wozu soll das denn gut sein? VHDL und Verilog sind ja u.a. dazu da, um
Logik als Text darzustellen. Wenn du unbedingt willst, kannst dir
natürlich für jedes erdenklich Gatter als VHDL Modul schreiben und das
dann instanziieren. Aber das ist ja zwei mal von hinten durch die Brust
ins Auge.
Christian R. schrieb:> Wozu soll das denn gut sein?
Vermutlich "Back to the roots!"
Nach dem AND, OR und NOT dann ein XOR, dann ein Halbaddierer, daraus ein
Volladdierer, daraus ein Multiplizierer, und daraus dann eine
Motorsteuerung. Alles hübsch strukturell beschrieben. Wie bei den Amis,
die hier immer wieder mal aufschlagen...
Innovationstiefe? 0
Lerneffekt? ~0
Nutzen? <<0
Peter Bierbach schrieb:> Ich möchte einen Art Gatterbaukasten haben zum Spielen in VHDL.
Den hast du doch: verwende einfach die "eingebauten" Schlüsselworte AND,
NOT, OR, NOR, NAND, XOR und XNOR.
Lothar Miller schrieb:> Nur müsste man dann konsequenterweise auch das XOR aus Invertern und> Gattern aufbauen (siehe Bild Logik3.png)...
Wenn man sich mal so richtig selber weh tun will: siehe Anhang... ;-)
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