Forum: FPGA, VHDL & Co. 100MHz 32bit timer


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von Timo (Gast)


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Ich habe einen 32bit timer in vhdl auf einen spartan 3 implementiert. 
Die clock hat 100Mhz. Braucht man dafür timing constraints? Wenn ja 
welche?

von Lothar M. (lkmiller) (Moderator) Benutzerseite


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Timo schrieb:
> Die clock hat 100Mhz. Braucht man dafür timing constraints? Wenn ja
> welche?
Du solltest dann diese Taktfrequenz als Constraint angeben. Denn ein 
Constraint ist ja dein Wunsch an die Toolchain. Ohne ein Constraint (= 
Einschränkung, Vorgabe, Zwang) von dir dürfte sie deinen Zähler ja 
beliebig langsam implementieren. Denn ohne Vorgabe für die Taktfrequenz 
ist dann die einzige Vorgabe von dir: implementiere mir den 
32-Bit-Zähler!

: Bearbeitet durch Moderator
von Duke Scarring (Gast)


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Timo schrieb:
> auf einen spartan 3 implementiert

Die Xilinx-ISE nutzt ja noch die übersichtliche Syntax:
https://www.mikrocontroller.net/articles/UCF-Dateien

von Timo (Gast)


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Danke das hat geholfen und funktioniert wie erhofft.

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