Ich möchte einen Adressbaustein mit Hilfe eines GAL16V8D realisieren. In der Simulation mit der Software ispLever funktioniert die Schaltung. Ich habe die Logik Schaltung in das Gal gebrannt, die funktioniert aber sonderbarerweise nicht. Hab daraufhin eine einfache Schaltung in das Gal gebrannt, die funktionierte perfekt. Sobald ich mehr als 1 Register verwende funktioniert das Gal nicht mehr. Woran kann das liegen?
Hallo, was verwendest du denn zur Beschreibung? (Schaltplan, VHDL, ABEL) was meist du mit mehr als ein Register? Die Gals sind intern sehr beschränkt. Du kannst die 8 Ausgänge entweder als FlipFlop oder als Logik definieren. Weiterhin musst du bedenken, dass die Logik aus einem ODER Gatter mit 8 Eingängen besteht, wobei an jedem Eingang ein UND mit 24 Eingängen hängt.
Ich habe die Schaltung mit der schematischen Darstellung gezeichnet.
Beschreibung ist ABEL.
Der Report der Schaltung:
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ispLEVER 3.1 - Device Utilization Chart Mon Feb 09 20:37:04
2004
start_bis_bit2.bls
------------------------------------------------------------------------
--------
Module : 'start_bis_bit2'
------------------------------------------------------------------------
--------
Input files:
ABEL PLA file : start_bit2.tt3
Device library : P16V8R.dev
Output files:
Report file : start_bit2.rpt
Programmer load file : start_bit2.jed
------------------------------------------------------------------------
--------
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start_bis_bit2.bls
P16V8R Programmed Logic:
------------------------------------------------------------------------
--------
N_8.D = ( !N_8.Q & !RESET & !SDA & !SCL
# !N_10.Q & !RESET & !SDA & !SCL ); " ISTYPE 'INVERT'
N_8.C = ( CLK );
N_10.D = ( !N_9.Q & !RESET & !SDA & SCL
# !N_10.Q & !RESET & !SDA & SCL ); " ISTYPE 'INVERT'
N_10.C = ( CLK );
N_9.D = ( !RESET & SDA & SCL ); " ISTYPE 'INVERT'
N_9.C = ( CLK );
N_7.D = ( !N_7.Q & !RESET & SDA & !SCL
# !N_8.Q & !RESET & SDA & !SCL ); " ISTYPE 'INVERT'
N_7.C = ( CLK );
N_11.D = ( !N_7.Q & !RESET & SDA & SCL
# !N_11.Q & !RESET & SDA & SCL ); " ISTYPE 'INVERT'
N_11.C = ( CLK );
N_38.D = ( !N_3.Q & !RESET & SDA & SCL
# !N_38.Q & !RESET & SDA & SCL ); " ISTYPE 'INVERT'
N_38.C = ( CLK );
out.D = ( !N_38.Q & !RESET & SDA & !res_pin2 & !SCL
# !res_pin2 & !out.Q ); " ISTYPE 'INVERT'
out.C = ( CLK );
N_3.D = ( !N_3.Q & !RESET & SDA & !SCL
# !N_11.Q & !RESET & SDA & !SCL ); " ISTYPE 'INVERT'
N_3.C = ( CLK );
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start_bis_bit2.bls
P16V8R Chip Diagram:
------------------------------------------------------------------------
--------
P16V8R
+---------\ /---------+
| \ / |
| ----- |
CLK | 1 20 | Vcc
| |
RESET | 2 19 | !N_3
| |
SDA | 3 18 | !out
| |
res_pin2 | 4 17 | !N_38
| |
SCL | 5 16 | !N_11
| |
| 6 15 | !N_7
| |
| 7 14 | !N_9
| |
| 8 13 | !N_10
| |
| 9 12 | !N_8
| |
GND | 10 11 |
| |
| |
`---------------------------'
SIGNATURE: N/A
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start_bis_bit2.bls
P16V8R Resource Allocations:
------------------------------------------------------------------------
--------
Device | Resource | Design |
Resources | Available | Requirement | Unused
======================|===========|=============|==============
| | |
Input Pins: | | |
| | |
Input: | 10 | 5 | 5 ( 50 %)
| | |
Output Pins: | | |
| | |
In/Out: | 8 | 8 | 0 ( 0 %)
Output: | - | - | -
| | |
Buried Nodes: | | |
| | |
Input Reg: | - | - | -
Pin Reg: | 8 | 8 | 0 ( 0 %)
Buried Reg: | - | - | -
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start_bis_bit2.bls
P16V8R Product Terms Distribution:
------------------------------------------------------------------------
--------
Signal | Pin | Terms | Terms |
Terms
Name | Assigned | Used | Max |
Unused
=========================================|==========|=======|=======|===
====
N_8.D | 12 | 2 | 8 |
6
N_10.D | 13 | 2 | 8 |
6
N_9.D | 14 | 1 | 8 |
7
N_7.D | 15 | 2 | 8 |
6
N_11.D | 16 | 2 | 8 |
6
N_38.D | 17 | 2 | 8 |
6
out.D | 18 | 2 | 8 |
6
N_3.D | 19 | 2 | 8 |
6
==== List of Inputs/Feedbacks ====
Signal Name | Pin | Pin Type
=========================================|==========|=========
CLK | 1 | CLK
RESET | 2 | INPUT
SDA | 3 | INPUT
res_pin2 | 4 | INPUT
SCL | 5 | INPUT
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start_bis_bit2.bls
P16V8R Unused Resources:
------------------------------------------------------------------------
--------
Pin | Pin | Product | Flip-flop
Number | Type | Terms | Type
=======|========|=============|==========
6 | INPUT | - | -
7 | INPUT | - | -
8 | INPUT | - | -
9 | INPUT | - | -
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