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Forum: FPGA, VHDL & Co. Xilinx ucf und ise 9


Autor: no_one (Gast)
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Hallo,
ich bin gerade dabei, mich genauer mit den ucf zu beschäftigen. Ich 
versuche für eine Instanz eine AREA_GROUP Constraint anzulegen. Dies 
erfolgt bei mir mit
INST "math_inst_01" AREA_GROUP = "AG_reconfig_addsub" ;
. Die entsprechende Instanz erzeuge ich in dem Top-Modul mit :
  
math_inst_01 : math_ip   Port map( ... );
.
Wenn ich ISE das System Synthetisieren lasse, gibt es keine Fehler und 
ich kann die unterschiedlichen Module auch im RTL Plan sehen. Sobald ich 
aber das Design Implementieren will, gibt es Fehler. Ich bekomme dann :
"ERROR:NgdBuild:753 - "top.ucf" Line 9: Could not find instance(s) 
'math_inst_01'
ERROR:Parsers:11 - Encountered unrecognized constraint while parsing.
ERROR:NgdBuild:19 - Errors found while parsing constraint file 
"top.ucf"."

Ich habe hier ein Design von Xilinx zum vergleich, wo es genau so 
gemacht wird, aber es lässt sich implementieren. Muss ich noch iwo was 
Einstellen, oder beachten?

MfG

Autor: Fpga Kuechle (fpgakuechle) Benutzerseite
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no_one schrieb:
> Hallo,
> ich bin gerade dabei, mich genauer mit den ucf zu beschäftigen. Ich
> versuche für eine Instanz eine AREA_GROUP Constraint anzulegen. Dies
> erfolgt bei mir mit
INST "math_inst_01" AREA_GROUP =
> "AG_reconfig_addsub" ;
. Die entsprechende Instanz erzeuge ich in
> dem Top-Modul mit :
> math_inst_01 : math_ip   Port map( ... );
.
> Wenn ich ISE das System Synthetisieren lasse, gibt es keine Fehler und
> ich kann die unterschiedlichen Module auch im RTL Plan sehen. Sobald ich
> aber das Design Implementieren will, gibt es Fehler. Ich bekomme dann :
> "ERROR:NgdBuild:753 - "top.ucf" Line 9: Could not find instance(s)
> 'math_inst_01'
> ERROR:Parsers:11 - Encountered unrecognized constraint while parsing.
> ERROR:NgdBuild:19 - Errors found while parsing constraint file
> "top.ucf"."
>
> Ich habe hier ein Design von Xilinx zum vergleich, wo es genau so
> gemacht wird, aber es lässt sich implementieren. Muss ich noch iwo was
> Einstellen, oder beachten?
>
> MfG

Versuch wildcards:
INST "*math_inst_01*" AREA_GROUP = "AG_reconfig_addsub" ;
MfG,

Autor: no_one (Gast)
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Hey...
das hab ich auch schon gemacht ... auch sowas wie top/math_inst_01 hab 
ich schon probiert...hat aber alles nicht hingehauen...

muss ich iwie besonders auf die formatierung achten? oder muss die 
instanz eine besondere größe haben?

mfg

Autor: Andreas (Gast)
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Hallo No_One,

versuche einmal mit dem FPGA-Editor deine Elemente wiederzufinden.
Dann hast Du auch die korrekte Schreibweise.

Wenn Du z.B. deine Elemente in einer Loop erzyeugst, wird Dir jedes 
Synthesetool (auch die XST) da etwas anghaengen (gen...), das ganze mit 
einem . oder / vom Rest trennen etc. Das ist ein schoenes Spiel, da sich 
das ganze auch ab und an ( bei verschiedenen Softwareversionen, habs 
aber auch schon bei Codeaenderungen an Stellen die nicht direkt in 
Verbindung mit dem jeweiligen Objekt standen beobachtet)...

Gruss

Andreas

Autor: no_one (Gast)
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hi...
das hatte ich auch schon getan.Anders als die übirgen Komponenten wie 
z.b. microblaze/uart hatte er das  math_inst.. nicht zusammengefasst. 
Es wurde aber alles als top/math_inst_01/.. angezeigt.

Ich werds aber heut abend nochmal probieren.

mfg und schonmal Danke für die Hinweise

Autor: no_one (Gast)
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Hallo nochmal
ich hab jetzt das ucf auf "*math_inst_01*" geändert, vorher hatte ich 
nur "*math_inst_01" ausprobiert, und jetzt geht es. Was mich aber 
wundert ist, dass es bei dem Bsp. ohne Wildcards geht. Ich versteh nicht 
wirklich wo der unterschied ist....

mfg

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