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Forum: FPGA, VHDL & Co. VHDL: Erzeugen vonn Wait-States


Autor: Thorsten (Gast)
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Ich habe eine kleine Frage zu VHDL:

ich habe einen mit 33MHz getakteten Prozess. Innerhalb des Prozesses
möchte ich nun 5 clk Zyklen warten, sprich wait-states einfügen.

Wie realisiere ich diese wait-states am elegantesten und
übersichtlichsten (counter, procedure, function etc.)

Bin auf Eure Antworten gespannt.

Gruß Thorsten

Autor: Christian (Gast)
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Ich würde es innerhalb eines Automaten mit einem Zähler realisieren,
also ein Wait Zustand, der verlassen wird, wenn von 1 bis 5 gezählt
wurde.

Autor: Jürgen Schuhmacher (Gast)
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Je nach der weiteren Komplexität, würde ich einfach den Automaten 4
leere steps machen lassen- ich stamme aber auch aus einer Zeit, da man
mit Zellen noch sparsam umgehen musste :D

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