Probleme mit Quartus II und Bus und Chipauswahl

Gast #387868
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Hi

ich versuche grade in irgendeinen FPGA oder CLPD eine relativ einfache
Schaltung reinzubrigen.
Alles was reinsoll ist ein schieberegister mit 3 eingängen und 20
"Ausgängen". Quasi seriell rein und dann halt Parallel and den 20
Ausgängen anstehend.
Dahinter soll dann noch ein 20 Pin Latch und dessen Ausgang soll dann
mit den Output Pins verbunden werden.

3 Probleme,

1 )welchen Chip nehme ich dafür? Ich wollte keine 20 - 30 Euronen dafür
ausgeben.

2 ) wie bringe ich output pins an einen Bus dran? Ich weiss wie das mit
einzelnen pins geht aber der output des latches ist ein BUS und da kann
ich nicht einfach out pins dranmachen (oder ich bin zu doof dazu)

3) mein compiler meckert

****************************************************************
Warning: Design contains 5 input pin(s) that do not drive logic
  Warning: No output dependent on input pin "pin_name"
  Warning: No output dependent on input pin "pin_name2"
  Warning: No output dependent on input pin "pin_name3"
  Warning: No output dependent on input pin "pin_name4"
  Warning: No output dependent on input pin "pin_name5"
*****************************************************************
ich vermute mal selbiges kommt daher das ich keine outputs angegeben
habe?

nächtliche Grüsse

  Tobi
Gast #387873
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Hi
danke fuer den Tip.
Habe mich dann fuer einen epm7064STC44-10 entschieden.

Wie ist das denn mit dem JTAG fuers Programmieren?
Muss ich die pins explizit in Quartus platzieren oder reicht einfach
Programming Header dran und gut?
#387874
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Was meinst du mit "echten 5V"?
Die Ausgänge sind immer als TTL oder als CMOS Pegel spezifiziert.
Bei TTL ist nur garantiert, daß der Pegel größer 2.4 Volt ist.
Bei CMOS muß man im Datenblatt nachschauen, aber meist sind es 0.5 V
unter der Versorgungsspannung, also 4.5 V.

Klaus

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