Keine Ahnung, wo mein Beitrag von eben gelandet ist. Also, ich habe bisher erste oder zweite Gehversuche in VHDL gemacht. Stepper und Modellbauservos und sowas. Die Beschreibung fällt mir auch eigentlich nicht besonders schwer, aber bei etlichen ineinander geschachtelten If-Bedingungenhätte ich doch auch gerne mal die Hardwareansicht. Geht das irgendwie, aus der VHDL-Beschreibung, rückwärts eine Schaltung zu generieren? Gruß ts
Hi, meinst du vielleicht beim ISE Webpack unter Sytnthesize -> View RTL Schematic? Mfg, Dirk
danke, und genau da (synthesize XST) steht ein fettes Ausrufezeichen...geht irgendwie nicht. 7.01.4i ist die Version. was fehlt mir (außer 'nem Äppler?). guude ts
Hallo, optisch sieht es fast gleich aus, natuerlich muss das Design vorher synthnesized werden. Dirk
Gibt es bei mir nicht. Ich glaube, ich muß es mir mal in neuerer Version runterladen. Melde mich dann wieder. Danke für die Mühe, die ich aber gerne gemacht habe. ts
Kam gerade als Tip of the Day: Design Tips: When using XST for synthesis you can use the RTL Viewer to see a schematic representation your synthesized design. Open the RTL Viewer by expanding the Synthesis-XST process tree and selecting View RTL Schematic. ;) Gruss Tobias
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