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Forum: FPGA, VHDL & Co. Interne Zähler realisieren


Autor: Paul (Gast)
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Guten Abend,

ich benutze innerhalb eines Processes eine variable zum Zählen. Sollten 
bestimmte Zählstände der Variable (Bedingungen) erfüllt sein, dann 
werden Aussagen einer if-Anweisung war und die If-Anweisung wird 
abgearbeitet. Bei bestimmten Signalzuständen wird der Wert der 
Zählvariablen wieder auf Null gesetzt. Die Variable wird nie einem Port 
oder Signal übergeben, weil wirklich immer nur die If-Bedingungen 
erzeugt werden sollen. Bei der Synthese erhalte ich denn immer die 
Meldung:

"WARNING:Xst:1291 - FF/Latch <ff_inst> is unconnected in block 
<my_block>."

Was mach ich falsch?

Kann mir bitte jemand helfen?

Gruß
Paul

Autor: hotline (Gast)
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Code posten.

Autor: Mark (Gast)
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nimm ein Signal, keine Variable. Variablen braucht man in VHDL recht 
selten
und wer den Unterschied zwischen Signal und Variable nicht verstanden 
hat macht meistens Fehler. Ich vermute dass das in Deinem Code auch der 
Fall ist.

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