Bausteinauswahl

Gast #1811420 
Hallo Forum,
ich habe jetzt schon geraume Zeit gegoogled und finde einfach nichts 
brauchbares. Ich möchte eine kleine Vorverarbeitung für andere Geräte in 
einem FPGA oder CPLD realisieren.
Mein Problem, ich muss Daten in der Logik entgegennehmen und puffern 
können. Hierbei kann es sich schon um einige kbit handeln. Nun würde ich 
gerne wissen ob ich das mit einem CPLD umsetzten kann... was den 
Speicherplatz betrifft. Also sehe ich das richtig dass ich mit einem 
CPLD pro FlipFlop (Makrozelle) ein Bit abspeichern könnte?
Ich finde einfach keine Daumenregel wie viel Makrozellen das speichern 
eines Bits belegt. Ich hoffe das kann mir einer von euch sagen.

Danke im Voraus für alle Antworten!
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Moderator (Firma: Titel) Persönliche Seite 
newbie schrieb:
> Ich finde einfach keine Daumenregel wie viel Makrozellen das speichern
> eines Bits belegt.
Genau 1 Makrozelle. Denn 1 Makrozelle hat genau 1 Flipflop.

CPLDs haben eine mächtige Logik, aber lausig wenig Speicherelemente. 
Deshalb wurden FPGAs erfunden...  ;-)

> Hierbei kann es sich schon um einige kbit handeln.
D.h. ein CPLD allein kann das nicht mehr.
Evtl. könntest du extern einen Speicher anklemmen, aber insgesamt sieht 
das eher nach einer Aufgabe für ein kleineres FPGA aus.

> Ich möchte eine kleine Vorverarbeitung für andere Geräte in
> einem FPGA oder CPLD realisieren.
Was denn?
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Gast 
Die genauen Funktionen sind noch nicht ganz klar. Es werden wohl Dinge 
wie Adressfilter, Zeitstempelung von Daten, bereithalten der Daten und 
vielleicht CRC Check in den FPGA gepackt.
Ich denke mir würde dazu ein kleiner Spartan 3 XC3S200 reichen. Momentan 
suche ich ein Eval Board dazu. Hat einer einen Tipp für ein gutes? Ich 
brauche kein Display oder so, am liebsten recht preiswert, mit IO Pins 
die nach außen geführt sind und mit der ISE dabei. Am liebsten auch 
gleich mit JTAG Programmer dabei.

Hat einer einen Vorschlag?
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Gast 
Danke, dass sieht sehr gut aus. Aber kann man die Pinleisten frei als 
IOs verwenden? Es hört sich für mich so an als könne man da nur diese 
Erweiterungskarten anschließen.
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Gast 
Eine Frage hätte ich noch zu diesem Board. JTAG ist ja on Board, was ja 
eigentlich sehr komfortabel ist. Aber was bedeutet "Requires Adept 2.0"? 
Was ist das für eine Software.
Ich war eigentlich der Meinung ich kann mit ISE und einer JTAG 
Schnittstelle programmieren. Aber wie ich das hier verstehe brauche ich 
nochmal diese zusätzliche Software. Oder?

Und wenn ja, kann ich dann in meiner Entwicklungsumgebung wie gewohnt 
debuggen, oder habe ich dann garkeinen Zugriff auf das Board, bzw. nur 
über diese Adept Software?

Danke schonmal für eure Hilfe!
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Moderator (Firma: Titel) Persönliche Seite 
> Aber was bedeutet "Requires Adept 2.0"? Was ist das für eine Software.
Das ist eine externe Programmiersoftware von Digilent. Sie ersetzt das 
Impact von Xilinx.

> Und wenn ja, kann ich dann in meiner Entwicklungsumgebung wie gewohnt
> debuggen,
Du wirst deine Hardware sowieso anders debuggen werden. Da ist nichts 
mehr mit Schritt-für-Schritt auf der Zielplattform. Debuggen von FPGAs 
passiert vor der Implementation und heißt Simulation. Auf der 
Zielhardware hilft dir nur noch ein LogicAnalyzer weiter.

> oder habe ich dann garkeinen Zugriff auf das Board, bzw. nur über diese
> Adept Software?
Ja. So ist das.

> JTAG ist ja on Board, was ja eigentlich sehr komfortabel ist.
Wofür ist JTAG deiner Meinung nach komfortabel?
Setzt du da zu viele Erwatungen in diese Schnittstelle?
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