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Benutzer:Malzeit/MIDI2CV
einstellbare Referenz Optokoppler für galvanische Trennung Offene Probleme/TODO Schutz der Ausgänge, da Synthesizer gerne mit 12 V und mehr arbeiten und nicht jede angeschlossene Schaltung auf Anhieb fehlerfrei ist. Überspannungsschutz der Versorgungsspannung eingeleitet durch die Schutzschaltung für die Ausgänge
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Datei:Synthesizer.zip
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Datei:Fpga-gui-drum-synthesizer1.jpg
GUI für drum synthesizer
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Datei:Dds-reko-filter-interpol3a.gif
Interpolation durch Dithering und Rekonstruktionsfilter bei direkter digitaler Synthese - Beispiel 1
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Datei:Dds-reko-filter-interpol3b.gif
Interpolation durch Dithering und Rekonstruktionsfilter bei direkter digitaler Synthese - Beispiel 2
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Datei:Dds-reko-filter-interpol3c.gif
Interpolation durch Dithering und Rekonstruktionsfilter bei direkter digitaler Synthese - Beispiel 3
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Datei:Laplacegenwaveforms.jpg
Beschreibung. Wellenformen f�r wave table Synthese, erzeugt mit LaPlace-Wellenform-Generator. Lizenz.
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Datei:4ch fpga built in oscilloscope.jpg
Beschreibung. screenshot of a built in FPGA oscilloscope in an audio synthesizer using 4bit per channel VGA output at 1920x1080 p60 analog connection. Lizenz.
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Datei:Laplacegenwaveforms2.jpg
Beschreibung. dynamic wave table synthesis with harmonic sine waves Dynamische Wellenfeldsynthese mit kontinuierlichen Wellen - ähnlich wave table synthesis auf der Basis in Echtzeit erzeugter Sinuswellen Lizenz.
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Datei:PLL-Rastbereich log.pdf
liegt der originale VCO-Bereich ? Das Datenblatt gibt keine Hinweise. Ist es ein fractional-n-Synthesizer ?
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Datei:Band limited square waves pyratone synth.jpg
einer Grundwelle mit X3, X5, X7 und X9 - hier erstellt mit Echtzeitsynthese aus Pyratone-FPGA-Synthesizer. Lizenz.
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Glitch
werden, um ein stabiles Ergebnis zu erhalten. Im Allgemeinen sind FPGAs und die zugehörigen Synthesewerkzeuge auf synchrone Schaltungen ausgelegt. Aber es gibt ein paar schmutzige Tricks, welche in der guten, alten TTL-Zeit funktionierten, weil die relativ langsamen ICs und die großflächige Verkabelung
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Taktung FPGA/CPLD
Umsetzung in VHDL. Takterzeugung mit PLLs. Clock Skew. Mithilfe der clock skew Einstellung kann ein Synthesewerkzeug angewiesen werden, den Zeitpunkt der Taktflanke entsprechend den Erfordernissen der Schaltungsverzögerungen einzustellen. Dies schafft mehr Reserven. Üblicherweise werden die Takte im FPGA so
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Xilinx Microblaze MCS Workflow
output signal generiert werden das immer beim Erreichen der '0' invertiert wird. Mit Vorbereitung Synthese mit MCS core. Top-Level. FPGA Implementierung. Am besten den FPGA mit den µB-MCS vor der Vorbereitung des SDK komplett implementieren und auf das Board laden. Es müßen die LED's 7 und 8 mit jeweils
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Klangerzeugung
für eine Mehrwegrückführung findet sich hier: Im Einzelfall können die Werte auch wie bei der synthetischen Klangerzeugung generisch erzeugt werden: Wellenformerzeugung. PDM-EXOR-Dreiecksgenerator. Durch die Interferenz zweier 1-Bit-Rechtecksignale mit geringfügig unterschiedlicher Frequenz und multiplikativer
Abstumpfung im Gehör führen und wichtige Töne dann nicht mehr wahrgenommen werden. Artikel. AVR-Synthesizer OneBitSound AVR-Synthesizer Digitale Sinusfunktion Pulsdichtemodulation Vervielfachung der Frequenz mittels Multiplikation Weblinks. (TODO: Sichten und den verschiedenen Methoden zuordnen) Doorbell
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DDS-Signalgenerator per USB
Analyzer genau wie moderne Messgeräte über USB. Lösung ist ein DDS, dies steht für Direct Digital Synthesis und ist ein Verfahren zur Erzeugung periodischer Signale. Dies kann sowohl ein Sinus-, Dreieck- oder Rechtecksignal sein. Nimmt man nun noch einen PWM-Kanal dazu, so hat man wirklich alles Wünschenswerte
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Digitale Sinusfunktion
Systemen wie Magnetik anwendbar. = Fußnoten = =Links= Diskussion um DDS: Suche im Forum nach DDS Sinus Synthe… Tonerzeug…
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Projekt VGA Core in VHDL
Elemente und kann leicht portiert werden. Die FFT ist maximal ausgebaut und per area constraint synthetisiert, um das design erzeugt zu bekommen. Um das Design praktisch zu verwenden, müsste die FFT gekürzt werden. Eigene Module können eingehängt werden, indem man sich auf die bereitgestellten Video-X
produziert bis zu 20MHz + 7 Oberwellen bis zu 160MHz. In einer Anwendung zur Klangsynthese (additive Synthese) werden ab 5Hz Oberwellen bis 50kHz erzeugt. Siehe Ein Funktionsgenerator mit FPGA Eingebautes virtuelles Oszilloskop. Um Messsignale in einem FPGA in Echtzeit beobachten zu können, wird ein virtuelles
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Durchblicker
unbedingt nötigen BRAM zur verwenden und die gesamte andere Logik aus LUT's aufzubauen wurde im Synthesetool (XST) die Option -bram_utilization_ratio 1# gesetzt, Für einen den Spartan6 - LX16 im CSG324 Gehäuse mit Speedgrade 3 ergibt sich mit der ersten beta-Implementation (2013-07-13) damit: + Ressourcen
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OneBitSound
Ästhetik des Ein-Bit-Klangs. Man stellt sich sicherlich die Frage nach der Zweckmäßigkeit der Ein-Bit-Synthese, wo doch die Rechenleistung des Controllers, welcher im Synthesizer One-Bit-Groovebox ( benutzt wurde auch für den Synthesizer AVRSYN ( mit der Sampletiefe vom 16 Bit ausreicht. Die negative Antwort
Perich (Link s.u.) für Controller mit Orchester demonstrieren tatsächliche Möglichkeiten dieser Syntheseart. wenig Rechenleistung erforderlich Wie dieser Artikel im Software-Teil zeigt, ist unter Verzicht auf Effekte, MIDI- und Sequenzer-Teil ist es möglich, auch die kleinsten Mikrocontroller zu nutzen
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TTL74185
für die Ausgänge. Um es dem Synthese-Tool leichter zu machen, wird das untere Eingangsbit nicht mit ausgewertet. Durch die select Anweisung beschreibt man eine Wahrheitstabelle die einfach in LUTs und Multiplexer umgewandelt wird (Xilinx
II. Synthese Ergebnis II. Zusammenfassung. Es gibt etliche synthetisierbare VHDL Lösungen für diesen einfachen Decoder. Die Optimierung der Tools verläuft vertikal vom Eingang zum Ausgang, horizontale Bezüge sind
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MIDI
Protokoll zum Übertragen von Steuerbefehlen zwischen elektronischen Musikinstrumenten wie Keyboards, Synthesizern, Samplern etc. und auch dem Computer. Zu Beginn war es für die Steuerung von monophonen Synthesizern erdacht worden, entwickelte sich dann aber weiter zum Standard für elektronische Musikinstrumente
zugeführt werden können, wie z.B. bei modernen DJ-Setups mit einem Sequenzer und mehreren monophonen Synthesizern. USB - Geräte. Üblicherweise gibt es beim USB-Bus genau einen host und eventuell mehrere slaves. Bei PC-Anwendungen ist dieser immer der host, d.h. sowohl das Keyboard, als auch der Musikerzeuger
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FPGA Soft Core
JTAG-Schnittstelle updaten. Somit kann neue Software getestet werden, ohne das Design neu zu synthetisieren. Dafür benötigt man die Werkzeuge hex2svf, svf2xsvf und xsvfplayer. Im FPGA füllt dann eine State-Machine am JTAG-Port einen DualPort-RAM (ROM :-)) Im Gegensatz zu neueren AVR-Controllern wie dem
Eindruck von derLeistungsfähigkeit der 32 Bit SoftCores gibt z. B. die Master-Arbeit "Evaluation of synthesizable CPU cores" aus dem Jahr 2004. Diese Vergleicht den Leon 2, MicroBlaze und OpenRISC 1200 miteinander. Lattice Mico32 und soc-lm32. Mico32 ist eine 32 Bit pipelined RISC CPU. Die steht unter einer
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Glossar
Digital Data Storage: Bezeichung für grosse Massenspeicher in der Computertechnik DDS: Direct Digital Synthesis: Verfahren zur Wellenformerzeugung - i.d.R ein Sinus DFS: Digital Frequency Synthesis: Allgemeiner Begriff bzw digitale Wellenformerzeugung DMX: Protokoll zur Steuerung von Lichteffektgeräten DRC
Analog-Digitalwandlung, bei der Endwert zu iterative Findung der Bits und Vergleich generiert wird SAR: Synthetic Aperture Radar: Eine Messwertverarbeitungsmethode in der Radartechnik, bei der durch eine virtuelle Positionsvariation eine künstlich vergrösserte "Blende" benutzt wird, um den Empfangsbereich zu
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VHDL Code Style und DO-254
bestimmt den Prefix der Regel. Beispielsweise SS-10 für die Zehnte Regel in der Kategorie "Safe synthesis" SS - Safe Synthesis CP - Coding Practice CDC - Clock domain Crossing DR - Code Reviews Jeder Regel ist ein Schweregrad (severity) zugeordnet: Note warning Error Ja nach Risikograd des designs kann
Fehler unter den Testbedingungen nie, sondern nur unter realen Einsatzbedingungen (Flug). Sichere Synthese - Safe Synthesis (SS). Vermeide implizierte Logik (SS1). Erlaube keinen Code der feed-throughs, Schieberegister und interne Tristate-Treiber impliziert. Stelle ordentliche Case-Anweisungen sicher
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Stromversorgung für FPGAs
sel sel Modus 0 0 inaktiv 0 1 konstante Umschaltung 1 0 Burstbetrieb VHDL Code. Wenn der Code synthetisiert wird, muss die Option "remove duplicate registers" in der Synthesesoftware ausgeschaltet werden. Es sollten zwei Dateien angelegt werden, top.vhd und row.vhd. Datei top.vhd Datei row.vhd Messungen
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Modellierung analoger Schaltungen
70.900 19.040 4.786 428 Monophoner Analogsynthesizer 27.840 13.200 3.624 934 77 8-fach polyphoner Synthesizer mit Filtern 4.200 1.968 545 140 11 Anmerkungen. Unter der Annahme einer optimalen Ausnutzung des Chips und der typischen Auslastung der Fläche wie oben angesetzt, ergibt sich bei der Taktfrequenz
HIFI-Amp mit Preamp 21 10 3 0,7 0,1 Monophoner Analogsynthesizer 4 2 0,5 0,1 0,01 8-fach polyphoner Synthesizer mit Filtern 0,6 0,3 0,1 0,02 0,001 Anmerkungen. Bei einem CUBE-System aus 16 FPGAs ergibt sich die Möglichkeit, die Rechnung als solche aufgrund der benötigten Hardware sehr wohl zu implementieren
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GPS-Platine mit Tyco-Modul
als unsymetrisches Signal auf der Pfostenleiste ausgegeben wird. In diesen Signalweg kann ein synthetisiertes Signal (von TIOA0 über Filter erzeugt) eingekoppelt werden. Die Einkopplung des Signals wird mit +5V an Pin 1 eingeschaltet. Die weiteren Pins werden zum überwiegenden Teil durchgeschliffen. Antennenbuchse
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Low Cost FPGA Konfiguration
unter Startup Options -> FPGA Start-up Clock "CCLK" gewählt werden. Im Xilinx ISE den kompletten Synthesezyklus inclusive "Generate Programming File" durchlaufen. IMPACT starten und eine PROM-Datei im BIN Format erzeugen. Jetzt hat man die Wahl zwischen zwei Möglichkeiten. Die Daten direkt in den EEPROM
FPGA_Konfiguration_mit_AVR_Butterfly Diskussion im Forum. Programm auf Spartan 3A laden FPGA synthetisierung Einsteigerfreundlicher FPGA Spartan 3E mit SPI-Flash Spartan 3e: Anfägerhilfe bei Flashspeicherung Programmier-Hardware Altera Cyclone-II /EPCS4 FPGA und CPLD programmieren Links. FPGAs von Xilinx
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Drehgeber
in Form eines CPLD oder FPGA. VHDL ist eine weit verbreitete Sprache zur Logikbeschreibung bzw. Synthese. Der folgende Code tastet die beiden Quadratursignale ab und generiert daraus ein UP/DOWN Signal sowie ein Clock Enable für einen Zähler, mit dem dann die aktuelle Position erfasst werden kann. Zusätzlich
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AVR Softwarepool
mit nur einer Kontaktfläche (C) Einfache Sensortaste Tonerzeugung. (A) ATMEGA8 Soundgenerator/Synthesizer (C) Klingel mit 100 Melodien - last minute Weihnachtsgeschenk (C) RTTTL Melodiegenerator mit ATTINY85 (B) RTTTL Melodiegenerator mit ATMEGA8 (A) Melodie ausgeben mit AVR ATTiny12 (A) µCke Microcontroller Mücke (Atmel Tiny13) (B) Melodieklingel BASCOM ATmega8 (A) 2Kanal Synthesizer ATtiny 2313, 85, .. (A) 17 Kanal Avr Synthesizer (C) AVR-Synthesizer TWI. (C) AVR TWI Master und Slave Funtionen in C (A) TWI / I2C einf. MASTER SLAVE Beispiel(Assembler) ATmega8 USB. (C) USB Host
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DDS basierter Funktionsgenerator mit AD5930
AD5930 ist ein Signalgeneratorbaustein von Analog Devices, der nach dem DDS-Prinzip (Digital Direct Synthesis) arbeitet. Mit dem speziellen Exemplar lassen sich sinus- und dreieckförmige Signale erzeugen. Dazu wird ein Frequenzwort per SPI-Schnittstelle an das DDS-IC übertragen. Im Gegensatz zu anderen DDS-Bausteinen
Frequenzauflösung von 3 Hz/Inkr. Um die Taktfrequenzen zu erzeugen, wird zunächst ein programmierbarer Synthesizer, der CDCE913 von Texas Instruments, eingesetzt. Mit diesem und einem extern angeschlossenen Quarz ist es möglich, die notwendige Taktfrequenz für den DDS-IC bereitzustellen. Er verfügt über eine
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Digitale Signalverarbeitung
auszugeben. Eine variable Frequenzeinstellung kann man durch die Methode der Direkten Digitalen Synthese (DDS) realisieren. Digitaler Funktionsgenerator - ausführliche Erklärung des Verfahrens im PDF, Beispielcode für AVR - noch ein AVR-Projekt - noch eine Erklärung Aplication Note von Analog Devices
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Audio-DSP mit Spartan 3-FPGA
Grafik-Prozessor" integriert, der das Update des Displays und das Kopieren der Bitmaps übernimmt. Synth-Board. Komplettansicht in einem Cherry-Tastaturgehäuse (wie dafür gemacht :-)) im Synthesizer-Stil Der komplette Synthesizer mit schicker Frontplatte und passendem (oben schon erwähnten :-)) Cherry-Tastatur-Gehäuse
Tiefpass/Hochpass/Notch) [[Media:mc505-delay-demo.wav.zip|Delay-Demo (137BPM [657ms & 876 ms]/Chorus)]] Synth-Board Audio-Demos. Die folgenden Demos stammen vom DAP in Verbindung mit einem AVR, der die Filterkoeffizientenberechnung sowie eine komplette Synthesizersteuerung beinhaltet, also quasi einen Synthesizer
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Schaltungssimulation
I heard from most users is the Free version of Dionysus is the most powerful and easiest to use synthesis program available including software selling > $1000. Enjoy it and my offer stands if want I can walk you through a couple of designs with you to help you get comfortable with it." Elsie. a Windows
Functionality is limited 3rd order analog and IIR filters, and 10 tap FIR filters. Filters are synthesized. Frequency, time, and reflection analysis are performed on the ideal, unmodified filters only. Transfer functions are displayed in standard form only. HP AppCAD. RF design software is provided free
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Hilbert-Transformator (Phasenschieber) mit ATmega
man ohne synthetisches Filter aus. Anders bei Schallwellen. Der eine Speicher besteht hier sowohl aus Schalldruck als auch aus Schallschnelle. Sind beide um 0° phasenverschoben, so bewegt sich die Welle in die eine Richtung
Sinus-Signales (kann geringfügig abweichen aber korrigiert werden). Das Transformieren erfolgt meist synthetisch, z.B. in digitalen Signal Prozessoren. Die Hilbert-Transformation wird verwendet, wenn man Sinus-Signal und Cosinus-Signal benötigt aber nur das Sinus-Signal vorliegt. Beide Signale (sin(...) und
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MOTOROLA VIP1710
Aufgaben. Danach kommt ein ganz Normales JPG-Bild in der Auflösung 720x576. Die Box hat einen synthetischen MIPS-4kec-Core. Zu der verwendeten CPU vom Typ AMD (früher ATI) Xilleon 210 ist bislang kein Link zu einem Reference Manual o.ä. bekannt. Lediglich das Reference Manual des Xilleon 220 wurde bislang
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AVR-GCC-Tutorial/Die Timer und Zähler des AVR
kHz und ist weitab unhörbar sowie leicht mit Drosseln filterbar. 10 Bit sind für Sprachausgabe, synthetische Klänge und Geräusche aus einem Samplespeicher gut genug und bietet Reserve für eine Laustärke-Einstellung von 8-Bit-Samples. Zum Vergleich: ISDN-Telefonqualität entsprechen 13 Bit, per A-Law (USA
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LPC-Mikrocontroller
SimpleCortex LPCWare NXP MCU community LPC175/6x und LPC23xx pin Configurator MIDI controlled monophonic synthesizer based on the LPCXpresso 1768. An open source software library for NXP's Cortex-M3 based LPC1300 microcontroller family An open source software library for NXP's Cortex-M0 based LPC1100 microcontroller
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ZPU: Softcore Implementierung auf Spartan-3 FPGA
VHDL-Modul markieren und dann im Fenster Processes Doppelklick auf Generate Programming File. Hiermit synthetisiert Xi-linx das gesamte Projekt und führt auch vorher die Schritte Synthesize - XST und Implement Design durch. Es sollten vor allen drei Punkten hinterher ein grüner Haken stehen. Doppelklick auf
Datei zpu_bram.vhd. Abhängig von der Größe des Prozessorsystems und des verwendeten FPGAs kann die Synthese des Systems sehr langwierig sein. Damit nicht für jede Änderung am Programmspeicher der Cores das ganze System neu synthetisiert werden muss, wird von Xilinx das Kommandozeilen-Tool Data2MEM in der
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Retrocomputing auf FPGA
arwz.exe) erstellt. Application Note - Using DCM in Spartan3: Anleitung Archtecture wizard im Xilinx synthesis Guide S.23 ff. Alternativ hätte man statt mehreren Takten auch einen Takt und ClockEnable verwenden können. Dann hätte man aber auch den CPU-Core umschreiben und neu testen müssen. Da FPGA's und
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Verilog
Zuweisung kombinatorischer Logik wurde hier die blockierende Zuweisung verwendet. In Bezug auf die Synthese ist zu beachten, dass alle Kombinationen von sel in der case-Anweisung enthalten sein müssen, sonst ist es möglich, daß durch die Synthese ein Latch entsteht. Näheres kann dazu im "Synthesis User's
Simulation. Für Verilog gibt es die folgenden Simulatoren als Open-Source: Icarus Verilog CVER Synthese. Für ausgewählte FPGAs ist auch eine Synthese mit Open-Source-Tools möglich: Yosys Im folgenden wird etwas näher auf die Nutzung mit Icarus Verilog eingegangen. Icarus Verilog. Icarus Verilog ist
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FPGA
Datei festgelegt (Xilinx *.ucf, Altera *.acf, Lattice *.lpf). Alternativ können diese auch als Syntheseoption im Kommentarfeld des Verilog/VHDL Codes mit angegeben werden. Die Hersteller bieten FPGAs mit gleicher Anzahl von Logikelementen in unterschiedlichen Gehäusen an. So kann der FPGA mit der passenden
. Zudem kann sich der Code stark aufblähen und die Zusammenfassung etwaiger Redundanz durch die Synthese zu hohen Synthesezeiten führen. Applikationen, die nicht ganz so zeitkritisch sind, sollten lieber mit einer flexiblen, verschachtelten Struktur von 2 state machines abgearbeitet werden, bei denen
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Receiver-Mainboard Plattform Philips PNX8950
Spec Sheet - linuxtv.org Frontend Treiber Philips TDA6650 (5 V mixer/oscillator and low noise PLL synthesizer for hybrid terrestrial tuner) Datasheet - linuxtv.org Tuner Treiber Philips TDA8024T (IC Card Interface) Datasheet U19: Philips P89LPC921 8-Bit Mikrocontroller mit 8051-Kern U24: Philips PCF8563T
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RFM12
Übergang mit einer anderen Präambel besetzt werden. 0 = aus 1 = an rowspan=2|es rowspan=2|enable synthesizer rowspan=2|PLL-Synthesizer einschalten oder eingeschaltet halten Dient zum Verkürzen von Umschaltzeiten 0 = aus 1 = an rowspan=2|ex rowspan=2|enable xtal (Quarz) rowspan=2|Schaltet den Quarz-Oszillator
normal 1 = präziser rowspan=2|oe rowspan=2|offset enable rowspan=2|AFC-Offset freischalten (zum PLL-Synthesizer durchschalten) (Sicherlich nur sofern der Empfänger läuft, also er aktiv ist!) 0 = aus, AFC unwirksam 1 = ein, AFC wirksam rowspan=2|en rowspan=2|enable afc rowspan=2|AFC-Berechnung aktivieren 0
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Reichelt-Wishlist
Atmel AVR mit USB: AT90USB82 und ATmega32u4 | * Atmel AVR32 im TQFP | | | | | Atmel Dream Sound Synthesizer Chips, z. B. ATSAM3103 und ATSAM3308 | * Axis Etrax 100LX Risc Processor (kostenloses Linux-System vorhanden) | * Bessere Auswahl: statt MSP430F147, F148, F149 wenigstens einen mit DAC -> MSP430F16x
( -> AD9833BRM und AD9835BRU inzwischen lieferbar) EM4095 (RFID) | LMX2306/LMX2316/LMX2326 PLL Synthesizer von National | * LTC5540 (RF-Mixer 600MHz-1.3GHz) | SA612AD = NE612 (RF-Mixer bis 500MHz) * PLL Schaltkreise für Frequenzerzeugung. z. B. MC / ML145170 (SOIC16) / TSA5060A | | | | SI4735 Silicon
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Linksammlung
SPiC) Folien der Vorlesung, Übungen, Platine SPiCboard, Bibliothek, IDE, Projekte, Simulator. PLL-Synthesizer Tutorial kleines praxisorientiertes PLL-Tutorial zur Funktion, Reparatur und Steuerung einer PLL-Schaltung mit AVR ATtiny2313 über 3-Leiter-Bus Arduino t r o n i x s t u f f - Arduino Tutorials
beim Schaltplan bis hin zur Montage in ein Gehäuse. AVR Projektsammlung bei www.avrguide.com AVR Synth Electronic Lives Manufacturing - Aufbauten in Fädeldrahttechnik, tlw. auf Japanisch, aber mit englischen Sourcecodes AVR Synthesizer Wedis-Basteleck - Modellbahn DCC-Servo-Zubehördecoder DCC Servo
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Digitaler Funktionsgenerator
Signalform auf einem LCD Die Funktionserzeugung basiert auf dem Prinzip der Direkten Digitalen Synthese (DDS). Das Projekt war meine Facharbeit im Fach Physik (Note: 15 Punkte) und war deshalb hauptsächlich zur Demonstration des Verfahrens gedacht. Vielleicht ist es trotzdem auch zum Nachbauen oder
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Xilinx ISE
Fehlern. Leerzeichen in Dateipfaden vermeiden (Tools wie PACE kommen damit nicht klar) XST. Das Synthesetool wird immer pingeliger, oft kommt eine ältere Version weiter (Records an Generics,unsigned-Typ, nicht benutzte FSM-Zustände. Der VHDL-Syntaxcheck eines Simulators (z. B. Modelsim) ist robuster, schneller
erst nach ngdbuilt startet, hilft das nicht viel. Glücklicherweise gibt es ein Tool, dass den Synthese-Output vom XST in ein lesbares Format (EDIF) umwandelt. Diese nennt sich ngc2edif. Falls ngdbuilt (oder map) Komponenten nicht findet, liegt das oft daran, dass er in den falschen Verzeichnissen sucht
