Forum: FPGA, VHDL & Co.


Fragen zur Anwendung von CPLD & FPGA, VHDL, Verilog usw.


Betreff Autor Antworten Letzter Beitrag
neg. Zahlen multiplizieren Ron Napp 6
Konfiguration XC3S500E über SPI-Flash AnXilinxVerzweifler 2
Linux und USB JTAG von Digilent Gast 4
microblaze programm in externen sram laden matzunami 4
convertieren Mari Gross 1
ISE 11.1 brennen von XC9572 möglich? Mani 19
Datentyp umwandeln Mari Gross 11
verschiedene ELF-Files aus DDR2 SDRAM laden Michi 3
add wave parameter ModelSim Matthias Laubnitz 3
Bild- speicherung, -verarbeitung im FPGA matzunami 21
Xilinx MPMC erstellen gast 3
Interrupt von RS232(XUART_LITE) in Spartan-3A Michi 3
mit write dezimale zahlen schreiben Michael Sauron 8
Process bei zweitem Takt starten Timo 2
Abgespekter MiniLA in Pollin CPLD-Board Christian H. 2
Summe eines Arrays effizient berechnen Mike 5
Digilent JTAG USB Cable CPLD-Anfänger 4
Auswahl eines Bestimmten DCMs birdman 1
Spartan 6/Virtex-6 tools und doku Antti Lukats 9
SRAM reagiert nicht Michael Sauron 6
unterschiedlicher Takt NIOS <-AVALON-> Logik AL_JA 6
Der oder das FPGA? Timo 6
clocks in lattice ecp2 Bernhard P. 11
Unterschied IOBM/IOBS Xilinx OBUFDS Problem 1660ES 5
Procedure mit verschieden langen Vectoren Martina M. 2
LVDS, DDR-FF Problem Xilinx John-eric K. 1
CVSD Encoder in Fixpoint Hans-Werner 2
ISE Webpack 11 - Testbenchprobleme Tobias 19
Zuweisung von Signalen unterschiedlichen Typs dito 16
Fehler in ISE Webpack 11.1 Mani 0
While Schleife Synthetisieren oder umgehen Stefan K. 6
Final State Machine jochen 10
Anfänger: VHDL Synthese: Counter Chris 8
JF Flipflop Toggel erdnuss 2
T-FlipFlop bzw. JK im GAL hmpf 6
Problem bei Addition auf std_logic_vector Peter 4
Xilinx Spartan FPGA: SPI chip select geht nicht klaus 2
Suche Designs für Virtex-5 FPGA Jens Heyen 8
Falsche Signalausgabe im allerersten Takt! Oliver 9
Reihenfolge der If-Anweisung in einem Prozess Tom 6
Zweidimensionales Array initialisieren dito 2
Verifikationsplan Peter 19
Versionsinfo in Design unterbringen TheMason 16
Eingangswiderstand Virtex4 GPIO Stefan N. 4
Hilfe! VHDL Problem micky 1
Signalteiler Hans Lang 15
Signalsequenz speichern Hi 3
Kann man mit Impact SPI-Flash programmieren? klaus 12
BRAM - Disributed RAM Gast 8
Xilinx Synthese nur bestimmte Gatter ? Charakterlos 17
Xilinx SDK Projekt von 10.1 auf 11.1 portieren Andreas N. 3