Forum: FPGA, VHDL & Co.


Fragen zur Anwendung von CPLD & FPGA, VHDL, Verilog usw.

Betreff Autor Antworten Letzter Beitrag
VHDL Desing in Schematic verwenden? Felix L. 5
keine Variablen - case anweisung synthese 10
Jogdial Dekoder in VHDL Thomas 5
Implementierung der XILINX FFT-Core Cihan Kalayci 2
Speicherblockberechnung Marc85 1
Moore signale Übergeben Flexbex 8
ISE 10.1 does not reload the user constraints file Ale 4
ADC Interface in VHDL Tim S. 2
EmbDev.net concurrent event signals mansoor sharifi 9
VHDL Matrix Duo LED´s Patrick 52
Imagesensor: LVDS-Daten mit Xilinx FPGA capturen Full W. 23
CPLD Development Kit Empfehlung Bahro 1
Xilinx UCF: Busse zusammenfassen? Bronco 3
Cypress FX3 jetzt mit 381MByte Sebastian 12
Xilinx FIR Core Problem FIR_noob 9
EmbDev.net Network On Chip mansoor sharifi 2
DE0 Nano Fragen Felix L. 23
Ist Lesezugriff auf Cyclone II Memoryblock in einem Takt möglich MuePlus 11
Stromaufnahme im Ruhezustand Hans 3
Process wird kontinuierlich durchloffen - Altium LiveDesign Board Daniel Schindler 34
DE0-Nano SD-IP(Opencore) Wishbone Blueberry 12
Altera_DE0_Board / Cyclon III / Expension Header bzw. Pins welche Spannung ? Egal Warum 1
Kann man so etwas als Dev-Board missbrauchen? No Y. 20
Welcher Modus vor dem JTAG-Modus Hans 3
Fehler in der Übertragung Lassmiranda Densiwillja 19
Anodencontroller für LED Matrizen - bitte um Codekritik Alex T. 9
Initialzustand von Ausgang? Jens Langecker 4
Ethernet PHY bedienen Robert K. 18
Lattice FPGA über FTDI/JTAG konfigurieren Philip 3
1-Bit-Latch Warnung baumhous3 7
Digilent Adept unter OpenSUSE11 Josef G. 2
SDC File erstellen Christian Wolf 9
Bits in Wort zählen Bronco 21
EmbDev.net ethernet sgmii Kadiyam N. 0
Signalsynchronisation / Genlock Stefan K. 5
Actel Distributor der an privat verkauft? Tobi 4
Spannungspegel bei LVDS Ausgang am FPGA falsch, was tun? Christian Wolf 6
Quartus II Pinzuweisung nicht möglich Thomas Richter 15
C-Mod Board Xilinx CoolRunner II CPLD Fragen zur Benutzung der I/O Kontakte Amin A. 2
FPGA Board zum Anfangen Mike Mike 53
EmbDev.net Acquiring data from files eduardo melara 1
SD-Card support mit SPI (Altera) Reinhard H. 6
Suche Spartan3-Board Tobias V. 0
EIn- und Ausgänge zusammenfassen(VHDL). GS 18
EmbDev.net Testbench of d flip flop Fahim Khan 10
VHDL Buch - Unterschied? HDLer 2
locked Von Wahrheitstabelle zur Logik Amin A. 30
Xilinx: IO Register im IOB Bronco 8
Mehrere Frame Buffer nutzen Marc85 26
Ein EPCS - mehrere FPGA Björn B. 9
Lattice ECP2 FPGA in SPI Slave-Mode Ernst Heini 7